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컴퓨터 구조의 메모리 계층 구조와 Verilog로 SRAM 모델링하기

[Ch.5] SRAM의 장점 관련 질문

해결된 질문

312

xo

작성한 질문수 8

1

안녕하세요! SRAM의 장점 중

Mux, Demux의 딜레이를 줄일 수 있다는 부분에 대해 질문 드립니다.

 

(1) 제가 이해한 내용으로는, 데이터를 Read할 때 BL와 BLB을 모두 합친 16개의 signal을 보기 위해 MUX 16:1이 필요한 걸로 볼 수 있지만, Sense amp로 인해 1-stage를 줄일 수 있기 때문에 딜레이를 감소시킬 수 있는 것으로 이해했습니다. 이렇게 이해하는 것이 맞는지 궁금합니다.

(2) Sense amp 없이도 BL 8개만 확인하여 출력을 얻어내는 방식을 사용할 수 있다고 생각했는데, 이러한 방식은 왜 사용하지 않는지 궁금합니다.

항상 좋은 강의와 함께 질문글 읽어주셔서 감사합니다!

컴퓨터-구조 verilog-hdl fpga 임베디드 amba

답변 1

0

회로설계 멘토 삼코치

안녕하세요, 답변 남겨드립니다.

해당 내용은 제가 라이브 방송을 통해 답변을 드린 부분이 있어서 공유드리려 하는데요,

https://cafe.naver.com/samcoach/174

혹시 카페에 가입 및 구글폼 제출을 통해 등급업을 하셨다면 확인해보실 수 있습니다!

확인에 문제가 있다면 다시 한 번 질문주시겠어요?

 

 

감사합니다 :)

1

xo

라이브 보면서 이해했습니다! 감사합니다!

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