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디지털 회로설계 실무 : Computer Architecture 와 SoC 프로토콜 Digital IP 설계하기

test bench 작성 후 RTL 시뮬레이션

해결된 질문

244

paulo129

작성한 질문수 1

1

강의에서 소개되는 FA_4bit를 RTL 시뮬레이션 해보려고 하였으나 위와 같은 오류창이 계속 뜹니다. tb명은 FA4bit으로 하였습니다. 해결할 방법이 있을까요?

컴퓨터-구조 verilog-hdl fpga 임베디드 amba

답변 1

1

회로설계 멘토 삼코치

네 안녕하세요, 답변 남겨드립니다.

에러 메세지를 보니
시뮬레이션을 돌리기 전에 분석과 합성을 모두 끝맞추어야한다고 써져있습니다.

플레이 버튼을 눌러서 합성을 진행했었는지 확인해주실 수 있을까요?

아마 합성만 잘 되면 문제 없이 동작할 듯 합니다.

잘 안 되면 한번 더 질문 남겨주시기 바랍니다!

1

paulo129

감사합니다! 해결하였습니다!

1

회로설계 멘토 삼코치

다행입니다! 또 진행 중에 막히는 부분이 있다면 질문주세요!

FIFO 질문

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cache관련 질문 드립니다

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강의 만료일 연장 신청

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강의자료 pdf파일

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수강기간변경

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프로그램 종류

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안녕하세요 강의 도중 궁금한 점 있어서 질문드립니다!

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수강기간 변경관련

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수강기간 만료

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수강 연장 문의

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I2C SCL_Synched, SDA_Synched 질문

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no data path질문

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DataMem 스펙 질문

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Hamming Code 질문

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Precharge에 대한 질문

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tpsram spec 질문

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학습 관련 질문 있습니다!

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