
Verilog FPGA Program 5 (Serdes)
alex
FPGAでLVDS(Serdes)を実装します。
中級以上
FPGA, verilog


学習した受講者のレビュー
5.0
mjs1004
DDR Controllerを使おうとしたら途方に暮れていたのですが、必要な核心部分をよく教えてくれる講義です。Xilinxのドキュメントをどこからどのように読めばいいのか困っていたのですが、講義受講後に道が見えるようになった気がします。良い講義ありがとうございます。
5.0
coldugs
FPGA 関連の資料は探すのも難しく、探しても量が膨大なので、学ぶのが難しいと思います。良い資料で、とても助かりました。
5.0
miheungsound
良い講義内容で大変役に立ちそうです。何度も繰り返して見ています。ありがとうございます。
DDRコントローラ
フレームバッファ
実力あるVerilog開発者に必要な
DDR Memory Controllerスキル! ✨
FPGAには多くの機能がIP形式で提供されています。その中でも、映像データの処理に主に使用されるDDRコントローラについて説明します。
1. データシートを見てそのまま実装
2. Xilinx社が提供するIPで実装
著者自身がDDRコントローラを実装する際、このような多くの困難を経験しました。必要な部分だけがまとめられた一冊のドキュメントがあればどれほど良いだろうかと、何度も考えました。最初は必要な部分だけを理解して開発を進め、DDRの読み書きを実際に行ってみてから、徐々に理解を深めていくのが効率的です。まず全体的な構造を理解し、後から詳細な内容を理解していくのが効果的です。本書はDDRコントローラに初めて接する開発者でも、容易にアプローチできるように構成されています。
DDRメモリは映像データ処理において非常に重要です。しかし、専門家でなければアプローチが難しく、またこのような専門的な内容を扱う資料がほとんどないのが現状です。本講義はDDRメモリコントローラを実装するすべての内容を扱っています。また、DDRコントローラを利用してフレームバッファを実装する内容についても詳しく説明しています。
💾 受講前にご確認ください!
DDR Memory Controllerに関する内容を扱っているドキュメントはほとんどありません。本講義では、すべての過程を詳細に説明いたします。Memory IPを生成してシミュレーションする過程から、汎用的に使用可能なDDR Memory Controllerの実装、映像データ処理のためのFrame Bufferを実装する内容まで、すべての過程を説明しています。また、ソースコードごとにシミュレーションを通じて検証し、動作を理解できるように構成されています。
本講義の内容をすべて理解すれば、DDRコントローラを実装できるだけでなく、Verilogを活用したFPGA実装の実力ある開発者になれるでしょう。
Verilogを学びたい方にとって、DDRメモリコントローラは非常に優れたスキルです。多くの開発経験を持つ方の中にも、DDRメモリコントローラに触れたことがない方はたくさんいます。Verilogのスキルを一段階アップグレードする機会を提供いたします。
本講義を購入される方には、講義で説明されているすべてのソースを提供いたします。提供されるソースは、講義を制作しながら最初から一つずつコーディングし、検証された資料で構成されています。また、現場ですぐに使用できるコードで構成されています。本講義を通じて、DDR Controllerのマスターになられることを願っています。
本講義は DDR Controller IPを生成する過程と、生成された IPがどのように動作するかを Simulationを通じて動作過程を理解し、生成された IPを利用して汎用的に使用できる DDR Controllerを設計します。最後に、映像データ処理のための Frame バッファを実装する過程を説明します。
本講義は、長年ISP(Image Signal Processing)開発に携わってきた著者の経験に基づいて構成されています。本書の内容は、実務にそのまま適用できるコードばかりです。内容に多少難しい部分が含まれることもありますが、理解できない部分は2〜3回ほど精読し、コードをSimulationしながら動作内容を復習してみてください。
本講義は、Digilent社が販売するArty A7開発ボードと、自社で販売するHIL-A25Tボードを使用して実習を行います。FPGAを扱う上で、HWに適用してその結果を確認することは非常に重要です。シミュレーションで実装することには限界があります。必ずHWで検証しなければなりません。(本書の最終章で扱うフレームバッファの内容については、適切なHWが見つからず、シミュレーションのみで検証を行うという心残りがあります。今後、適切なボードを見つけてHW検証まで進められることを期待しています)
1章は全体的な内容の概要です。
2章では実習に使用されるArty A7ボードについて説明します。
3章はDDR Controller IPを生成する方法とUser Interface Logicについて説明します。
4章では、生成された DDR Controller IPの Simulationを通じて動作特性を理解します。これは汎用的に使用可能な DDR Controllerを実装する上で非常に重要です。
5章では、汎用的に使用可能な DDR Controllerを実装し、これを利用してDDR Memoryの全領域を Read/Write することを実装します。またBitstreamを生成して、ボードで結果を確認します。
6章ではMemory Access速度に関する内容を確認し、最大速度を実現するための内容を扱います。
7章は5章で実装した汎用DDR Controllerを利用して、映像データ処理のためのFrame Bufferを実装します。
8章は16bits DDR Memory 2個を使用して 32Bits Interfaceを実装します。
9章はSpartan6でDDRコントローラを実装します。
10章ではDDR4コントローラを実装します。
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Q. Verilog初心者でも可能ですか?
Verilogに関する基本的な知識が必要です。関連する知識がないと難しい場合があります。
Q. 準備しておくことはありますか?
コードを実装し検証するために、Arty A7ボードを使用します。ボードが準備できれば、実装した内容を直接確認することができます。しかし、すべてのソースがシミュレーションできるように構成されているため、先に講義を受講し、ボードが準備できてから後で検証しても構いません。
Q. プログラムツールは何を使用しますか?
Xilinx社のvivado 2018.3を使用します。2018.3以降のバージョンであれば可能です。
私は20年余り、大企業や中小企業で開発者として働き、現在は小さな企業を経営しています。CCTV用ISP(Image Signal Processing)ASICを開発し、OLED検査装置、DAQ(Data Acquisition System)など、FPGAを利用した多くの製品を開発してきました。FPGAだけでなく、FW開発(STM32、PIC32、AVR、ATMEGAなど)、回路設計、Windowsプログラムなど、多くの経験を持っています。これまで私が積み重ねてきた幅広い経験をもとに、皆さんの学習の助けになることを願っています。
学習対象は
誰でしょう?
FPGAを用いた映像データ処理
フレームバッファの実装
Verilogを学びたい方
FPGAを学びたい方
前提知識、
必要でしょうか?
Verilog
vivado
FPGA
キャリア認証
1,791
受講生
96
受講レビュー
134
回答
4.8
講座評価
17
講座
私は過去20年余り、大企業や中小企業で開発者として働いてきました。
現在は小さな企業の代表を務めております。
主な経歴は以下の通りです。
Verilog HDLを用いたFPGA設計
CCTV用ISP ASICの開発(約10年)
OLEDディスプレイ検査装置の開発(約3年)
FPGAを用いた装置開発
MCU FW
STM32
PIC32
AVR, ATMEGA
DSP (TI)
Windowsアプリケーションプログラム
Visual Studio MFC, C++
です。
全体
277件
講座資料(こうぎしりょう):
全体
7件
5.0
7件の受講レビュー
受講レビュー 1
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平均評価 5.0
5
FPGA 関連の資料は探すのも難しく、探しても量が膨大なので、学ぶのが難しいと思います。良い資料で、とても助かりました。
私も初めて勉強したときは、何を学ばなければいけないのか、どう始めたらいいのか、途方に暮れていたような気がします。より有益な資料になるよう努力します。ありがとうございます~!!
受講レビュー 2
∙
平均評価 5.0
5
良い講義内容で大変役に立ちそうです。何度も繰り返して見ています。ありがとうございます。
ありがとう、講義を通してddr controllerを完全に理解してください。
受講レビュー 5
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平均評価 5.0
修正済み
受講レビュー 4
∙
平均評価 5.0
受講レビュー 2
∙
平均評価 5.0
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