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Verilog FPGA Program 6 (ddr Arbiter)

本講義では、DDR Memory Arbiterを実装します。

（5.0）受講レビュー 3件

受講生 12名

難易度 初級

受講期間 無制限

Verilog HDL
Verilog HDL
FPGA
FPGA
Verilog HDL
Verilog HDL
FPGA
FPGA

受講後に得られること

  • DDRアービタ

  • イメージフレームバッファ

本講義は、DDRメモリコントローラの最終段階であるArbiter（アービタ）を実装する内容です。DDRを画像データ用のフレームバッファとして使用する場合、DDRアクセス（リード/ライト）が重なることがあります。主に、入力と出力のフレームレートが異なる場合に発生します。このような場合には、Arbiterを設計してアクセス（リード/ライト）タイミングを調整する必要があります。リードとライトのリクエストを順次処理できるようにしなければなりません。

本講義は、入力イメージのフレームレートと出力イメージのフレームレートが異なる場合に、ddr Arbiterを実装してddrアクセスが重ならず順次行われるように実装します。結果をボードにダウンロードし、正常に動作することを確認します。

本文の構成は次の通りです。

2章は実習に使用されるArty A7-35Tボードについて説明します。

3章は大まかなシステム構成について説明します。

4章はモジュール別にプログラムを実装します。

5章はTop Moduleを実装し、シミュレーションで結果を確認します。

6章ではBitstreamを生成し、結果をボードで確認します。

💾受講前にご確認ください！

  • 本講義はPDF形式のテキスト講義であり、別途動画は提供しておりません。

  • 講義で説明されたすべてのソースコードを提供いたします。

  • 本講義は、Digilent社で販売されているArty A7ボードと、自社で販売しているHIL-A35Tボードで実習を行います。

  • HIL-A35Tボードは、自社で運営しているスマートストアで購入できます（スマートストアリンク：https://smartstore.naver.com/ihil）


  • 講義資料は「セクション 0 - 資料共有リンク - 添付ファイル」からダウンロードできます。


講師紹介✒

私は20年余り、大企業や中小企業で開発者として勤務し、現在は小さな企業を運営しています。CCTV用ISP（Image Signal Processing）ASICを開発し、OLED検査装置、DAQ（Data Acquisition System）など、FPGAを利用した多くの製品を開発してきました。FPGAだけでなく、FW開発（STM32、PIC32、AVR、ATMEGAなど）、回路設計、Windowsプログラムなど、多くの経験を持っています。これまで私が積み重ねてきた幅広い経験をもとに、皆さんの学習の助けになることを願っています。

こんな方に
おすすめです

学習対象は
誰でしょう？

  • Verilogを学びたい方

  • FPGAを学びたい方

  • ddr Arbiterを学びたい方

前提知識、
必要でしょうか？

  • verilog

  • vivado

  • xilinx fpga

こんにちは
alexです。

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講座

私は過去20年余り、大企業や中小企業で開発者として働いてきました。

現在は小さな企業の代表を務めております。

主な経歴は以下の通りです。

  • Verilog HDLを用いたFPGA設計

    • CCTV用ISP ASICの開発（約10年）

    • OLEDディスプレイ検査装置の開発（約3年）

    • FPGAを用いた装置開発

  • MCU FW

    • STM32

    • PIC32

    • AVR, ATMEGA

    • DSP (TI)

  • Windowsアプリケーションプログラム

    • Visual Studio MFC, C++

です。

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3件の受講レビュー

  • mjs1004님의 프로필 이미지
    mjs1004

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    本当に役に立つ講義をありがとうございます！

    • neulha님의 프로필 이미지
      neulha

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      • kyum5258802님의 프로필 이미지
        kyum5258802

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        本講義はDDR Memory Arbiterを実装します。

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        本講義はXilinx ZYNQボードを活用する内容です。この講義の内容を理解すると、Embedded_SW + User_Logicを理解し、実務に適用できるスキルを学びます。

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        この講義を通じて、受講生はZynqボードを活用してVerilogを実装する内容を学びます。

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        この講義はMicroblazeの上級コースです。講義を通じてMicroblazeの応用方法を学ぶことができます。

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        この講義を通じて、受講生はVerilogの学習に必要な基本的、核心的な知識を習得することになります。

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        講義を通じて、FPGAを利用したDDRコントローラを実装することができます。

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        STM32 で DSP ライブラリを使用して FFT を実装します。

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        CPUを作ろうと決心すると、たいてい回路図から探し始めます。ところが、図面を広げた瞬間に答えられない質問が生じます。「このブロックはなぜここにあるべきなのか？」「レジスターを読み取るポートはなぜ2つなのか？」 答えはすべて命令にあります。命令が何を要求しているかを知れば、どのような回路が必要かが決まります。逆の順序では成り立ちません。 RISC-Vの講義はすでにいくつもあります。しかし、その多くはスライドに値を表示して「こうなります」と言って次に進んでしまいます。受講生はその値が正しいか確認する方法がありません。 この講義では、Python命令実行シミュレーターを一緒にお渡しします。run ADDと打てば、その場で機械語が組み立てられ、32ビットがフィールドごとに展開され、レジスターがどのように変わるかが画面に表示されます。教材のすべての数字はこのツールの実行結果であり、皆さんの画面で全く同じように再現されます。 商用デバッガーはライセンスが必要で、シミュレーターはインストールが壁になります。このツールはPythonさえあれば十分です。ボードも、ライセンスも、インストールも必要ありません。 RV32I命令40個を一つも漏らさず直接実行しながら、回路が何をすべきかを自ら見つけ出す過程です。

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        Season 1が実力点検と基礎固めだったとするならば、Season 2はただ「合格と転職」のためだけの実戦圧縮トレーニングです。 単なる文法やゲートレベルを超え、実際に大手企業や外資系の現場、そしてコーディングテストで頻出する最上位の高難易度モジュール（CDC、同期/非同期FIFO、AMBA APB、SPI、I2C、FIRフィルタなど）を直接設計してみます。 面接官の深掘りするような圧迫質問にも揺るがない、確かな設計能力が必要ですか？地方大学から外資系半導体企業への転職を成し遂げたETAの実戦ノウハウのすべてと、コーディングテストの決定版といえる問題たちをこの講義にすべて詰め込みました。最後のシーズン、あなたの転職フリーパスを完成させてください。

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