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Verilog FPGA Program 6 - DDR Arbiter (Arty A7-35T)

Name: Verilog FPGA Program 6 - DDR Arbiter (Arty A7-35T)
Price: 110000 KRW

本講義はDDR Memory Arbiterを実装します。

（5.0）受講レビュー 1件

受講生 9名

ihil

ddrarbiter구현

fpga

verilog

텍스트 강의

FPGA

Verilog HDL

こんなことが学べます

DDR アービタ
画像フレームバッファ

このレッスンは、DDR Memory Controllerの最後のステップであるArbiterの実装について説明します。 ddrをImageデータのフレームバッファとして使用すると、ddr access（read / write）が重複することがあります。主に入力と出力のフレームレートが異なる場合に発生します。このような場合は、Arbiter を設計して Access (Read/Write) Timing を調整してください。読み込み、書き込み要求を順次処理できるようにする必要があります。

本講義は、入力ImageのFrame Rateと出力ImageのFrame Rateが異なる場合に、ddr Arbiterを実装してddr accessが重ならずに順次に行えるように実装します。結果をボードにダウンロードし、正常に動作することを確認します。

本文の構成は次のとおりです。

第2章では、練習に使用されるArty A7-35Tボードについて説明します。

第3章では、おおよそのシステム構成について説明します。

第4章はモジュールごとにプログラムを実装しています。

第5章はTop Moduleを実装し、Simulationで結果を確認します。

第6章はBitstreamを作成し、結果をボードで確認します。

💾受講前に確認してください！

本講義はPDF形式のテキスト講義で、別途映像を提供しません。
レッスンで説明されているモードソースコードを提供します。
Digilent社が販売するArty A7開発ボードで実習を進めます。

知識共有者の紹介✒

私は20年以上にわたり大企業、中小企業で開発者として働いてきましたが、現在は小さな企業を運営しています。 CCTV用ISP（Image Signal Processing）ASICを開発し、OLED検査装置、DAQ（Data Acquisition System）などFPGAを利用した多くの製品を開発しました。 FPGAだけでなく、FW開発（STM32、PIC32、AVR、ATMEGAなど）、回路設計、Windowsプログラムなど多くの経験を持っています。これまで私が積み重ねてきた幅広い経験をもとに、皆さんの学習に役立つことを願っています。

こんな方に
おすすめです

学習対象は
誰でしょう？

Verilogを学びたい方
FPGAを学びたい方
ddr Arbiter 習いたい方

前提知識、
必要でしょうか？

ベリログ
Vivado
xilinx fpga

こんにちは
です。

1,647

受講生

受講レビュー

123

回答

4.8

講座評価

講座

저는 지난 20여년 동안 대기업, 중소기업에서 개발자로 일해왔고

현재는 작은 기업의 대표로 있습니다.

주요 경력사항은

Verilog HDL을 이용한 FPGA 설계
- CCTV용 ISP ASIC 개발 (약 10년)
- OLED Display 검사장비 개발 (약 3년)
- FPGA를 이용한 장비 개발
MCU FW
- STM32
- PIC32
- AVR, ATMEGA
- DSP (TI)
Windows Application Program
- Visual Studio MFC, C++

입니다.

カリキュラム

全体

103件

講座資料（こうぎしりょう）:

授業資料

セクション 1．概要

4件

セクション 2．HW 構成

4件

5. HW構成 - 0
6. HW 構成 - 6
7. HW構成 - 7
8. HW構成 - 8

セクション 3．システム構成

3件

セクション 4．プログラム実装

69件

セクション 5．Top Module 実装

13件

セクション 6．ビットストリーム生成及び結果確認

8件

セクション 7．その他

2件

講座掲載日:

最終更新日:

受講レビュー

全体

1件

5.0

1件の受講レビュー

haneuli
受講レビュー 12
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