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Basic SystemVerilog Testbench ( 회로설계 검증 )

미션 3 로그 결과 문의

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안녕하세요 강의 수강 중 문의사항이 있어 문의드립니다.

미션3 진행 중 마지막 run을 통해 로그를 확인하였는데 [ENV] [GEN] [DRV] [MON] is started ... 가 아니라 [GEN]까지만 실행이 되고 종료 되는게 맞는지 궁금해서 문의드립니다. 저 pwrite도 is_write로 변경되어야 하는게 맞는지도 궁금합니다.

답변 1

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안녕하세요, 인프런 AI 인턴입니다.

SystemVerilog Testbench에서 각 요소들의 로그가 제대로 출력되는 것은 testbench의 이벤트 흐름을 이해하는 데 중요한 부분입니다. 질문 주신 로그 관련 부분은, 원하는 로그 메시지가 모두 출력되지 않는 것 같아, testbench의 구성이 올바르게 되었는지 체크할 필요가 있습니다.

  1. [GEN], [ENV], [DRV], [MON] 로그: 일반적으로 각각의 요소가 run() 메소드를 통해 로그를 출력합니다. 각 요소가 제대로 인스턴스화되고, run() 메소드가 실행되었는지 확인해야 합니다.

  2. pwrite 필드 명칭 변경: 기존 코드에서 pwrite가 사용되었다면, 요구사항이나 변경된 사양에 따라 is_write로 이름이 변경될 수 있습니다. Task나 모듈 내부에서 관련 필드가 모두 일관되게 변경되었는지 확인해야 합니다. 이름 변경이 요구된다면, 이에 맞게 코드의 모든 관련 부분이 수정되어야 합니다.

  3. Task나 모듈의 실행 및 연결 상태: 각 모듈이 제대로 생성되고, 다른 모듈과의 인터페이스가 올바르게 연결되었는지 확인하는 것이 중요합니다. 특히, wr_gen task에서 randomization이나 조건 설정에서 오류가 없는지 살펴보아야 합니다.

문제가 지속될 경우, 테스트 환경과 각 모듈의 초기화, 실행에 관련된 부분을 재검토하시는 것을 권장드립니다.

아래 링크를 참고하시어 비슷한 해결 방안이 설명되어 있는지 확인해보시길 권장드립니다:

저는 질문자님의 이해를 돕고자 지식공유자님의 기존 답변을 참고하여 유사한 답변 링크를 추천해드리고 있습니다. 현재 베타 기능으로 답변이 만족스럽지 않을 수 있는 점 양해 부탁드립니다. 🙏 추가적으로 궁금한 점이 있으시면, 이어서 질문해 주세요. 곧 지식공유자께서 답변해 주실 것입니다.

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