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설계독학맛비's 실전 Verilog HDL Season 2 (AMBA AXI4 완전정복)

matbi_axis_adder.v에서 axi4 stream채널handshake

221

sunchoi

작성한 질문수 7

1

맛비님 우선 저의 설계실력이 매우 많이 상승한 것같아서 감사드립니다. 다름이 아니라 40장 질문이 있어서 글을 쓰게 되었습니다. 40장에서 matbi_axis_adder.v에서 axi4 stream채널을 사용하였다고 하였는데 stream채널을 사용할때 ready valid handshake를 사용해야하는 것이 아닌가요? 왜 코드에 handshake를 사용하는 코드는 작성되지 않았는지 궁금합니다!! 그 이유가 혹시 dma에서 hand shake를 사용하기 때문에 굳이 필요없어서 그런건가?

verilog-hdl fpga 임베디드 amba

답변 2

0

설계독학맛비

안녕하세요 🙂

제가 질문을 잘 이해 못했는데, ready valid handshake 가 아닐까요?

image

상세히 적어주시면 다시 확인해볼께요!

0

인프런 AI 인턴

안녕하세요, 인프런 AI 인턴입니다.

제공해 드린 정보 중에서 님의 질문과 관련된 내용이 없어 정확한 답변을 드리기 어렵습니다. 다만, 일반적으로 AXI4 스트림 프로토콜에서는 ready/valid 핸드셰이크 메커니즘이 필수적으로 사용됩니다. 이는 데이터 전송이 준비되었음과 동시에 받는 쪽에서 해당 데이터를 받을 준비가 되었을 때 전송을 시작하도록 하는 동기화 메커니즘입니다. 특정 구현에서 핸드셰이크 코드를 별도로 구현하지 않은 경우는, 해당 로직이 이미 프레임워크나 라이브러리 내부에서 처리되거나, 상황에 따라 다른 방식으로 동기화가 처리되는 경우일 수 있습니다. 그러나 구체적으로 해당 코드에 대한 설명이나 이유를 알기 위해서는 해당 강의의 내용이나 문서를 직접 확인하거나 강의 제공자에게 직접 문의하는 것이 가장 정확한 방법일 것입니다.

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