듣는 내내 강의가 하나도 지루하지 않았어요 완전 강추합니다! 이렇게 좋은 강의 감사합니다 늘 한켠에 제쳐두고 미루기만 했었는데 덕분에 한걸음 더 나아갈 수 있었습니다 강사님 앞날에 무궁한 발전을 기원합니다~! 앞으로도 좋은 강의 많이 부탁드려요! oksu010@gmail.com (ㅎㅎ 자료도 같이 부탁드려요!)
학습하는 분들께 도움이 되고, 더 좋은 답변을 드릴 수 있도록 질문전에 다음을 꼭 확인해주세요. 1. 강의 내용과 관련된 질문을 남겨주세요. 2. 인프런의 질문 게시판과 자주 하는 질문(링크)을 먼저 확인해주세요. (자주 하는 질문 링크: https://bit.ly/3fX6ygx) 3. 질문 잘하기 메뉴얼(링크)을 먼저 읽어주세요. (질문 잘하기 메뉴얼 링크: https://bit.ly/2UfeqCG) 질문 시에는 위 내용은 삭제하고 다음 내용을 남겨주세요. ========================================= [질문 템플릿] 1. 강의 내용과 관련된 질문인가요? (예/아니오) 2. 인프런의 질문 게시판과 자주 하는 질문에 없는 내용인가요? (예/아니오) 3. 질문 잘하기 메뉴얼을 읽어보셨나요? (예/아니오) [질문 내용] 여기에 질문 내용을 남겨주세요. 교재 19페이지에 주문상품에 '보통 OrderLine, LineItem으로 많이 표현한다.' 라고 되어 있는데요, OrderItem이란 이름 대신 OrderLine 을 많이 사용한다는 뜻인가요 ?
공부하다가 문득... differentiation과 derivative의 차이가 명확하지 않은 것 같아서 질문 남겨봅니다;; differentiation은 기울기(x변화에 대한 y의 변화)를 구하는 미분이고, derivative는 도함수를 구하는 거라고 하는데... x에대한 편미분(partial derivative), y에 대한 편미분(partial derivative)를 구해서 기울기(differentiation)을 구하는 것으로 이해하는 게 맞는 이해일까요??;;;
설계독학맛비's 실전 FPGA를 이용한 HW 가속기 설계 (LED 제어부터 Fully Connected Layer 가속기 설계까지)
안녕하세요, 맛비님. 유익한 강의 감사드립니다. Lab 13 memory read/write 실습까지 마치고, 제가 설계한 core로 테스트해보는 중 문제가 생겨 문의 드립니다. 우선, register 0~3까지 사용하는 block 이며 0, 1에서 데이터를 받아 core에 넘겨주고, core가 메모리에 어떠한 데이터를 쓴 뒤, 강의처럼 2의 메모리 주소에 있는 데이터를, 3에 넣는 방식으로 설계해보았습니다. 이 동작은 AXI Verification IP에서는 의도대로 동작을 하고 있습니다. 그러나 이 core를 zynq에 연결하여 bitstream을 작성 후 vitis에서 똑같이 해보려했는데, 제대로 출력되지 않고, 항상 0이 출력됩니다. 이렇게 두 결과값이 다를수도 있는 것인가요..? 감사합니다.
설계독학맛비's 실전 FPGA를 이용한 HW 가속기 설계 (LED 제어부터 Fully Connected Layer 가속기 설계까지)
안녕하십니까? 이 강의에서 BRAM 영역의 Width와 관계없이, Addr[0], Addr[1]로 표현하셨는데, 이 메모리 공간의 실제 주소(절대 주소)가 어떻게 되는지 궁금합니다. 예로 0x4000 0000 에 BRAM을 할당 했을때, Addr[0] : Addr[1] : 각강의 주소가 어떻게 되나요? Width : 16 or 32일 때 가정해서 Width와 관계없이, 무조건 1씩 증가하는 것으로 봐야 하나요? 만약 VITIS에서 접근할려고 할 때, 주소를 어떻게 해야 할지 궁금합니다.
학습하는 분들께 도움이 되고, 더 좋은 답변을 드릴 수 있도록 질문전에 다음을 꼭 확인해주세요. 1. 강의 내용과 관련된 질문을 남겨주세요. 2. 인프런의 질문 게시판과 자주 하는 질문(링크)을 먼저 확인해주세요. (자주 하는 질문 링크: https://bit.ly/3fX6ygx ) 3. 질문 잘하기 메뉴얼(링크)을 먼저 읽어주세요. (질문 잘하기 메뉴얼 링크: https://bit.ly/2UfeqCG ) 질문 시에는 위 내용은 삭제하고 다음 내용을 남겨주세요. ========================================= [질문 템플릿] 1. 강의 내용과 관련된 질문인가요? (예) 2. 인프런의 질문 게시판과 자주 하는 질문에 없는 내용인가요? (예) 3. 질문 잘하기 메뉴얼을 읽어보셨나요? (예) [질문 내용] 아래 코드에서 Book 객체는 개발자가 임의로 만든 객체이고 form 객체의 id값은 이미 예전에 JPA가 저장했던 id값이니까 이 id값을 받은 book 객체는 기존 식별자를 가지고 있기 때문에 준영속 엔티티로 보는것인가요? @PostMapping("/items/{itemId}/edit") public String updateItem(@ModelAttribute("form") BookForm form){ Book book = new Book(); book.setId(form.getId()); //form은 이전의 jpa가 db에 저장했으니 form의 id값을 받은 book객체는 준영속 엔티티?? book.setName(form.getName()); book.setPrice(form.getPrice()); book.setStockQuantity(form.getStockQuantity()); book.setAuthor(form.getAuthor()); book.setIsbn(form.getIsbn()); itemService.saveItem(book); return "redirect:/items"; }
안녕하세요. 현재 한국과학기술연구원에서 갑작스레 FPGA를 이용한 회로설계를 구현하게 된 학생입니다..ㅠㅠ 설계해야 할 회로는, FPGA를 이용하여 28 channel 의 voltage pulse 를 만들어서 특정 구조의 반도체 device에 인가해주고, 그 소자로부터 10개 이상의 output 을 다시 multichannel로 반환받는 회로입니다. device는 28x28 의 crossbar array 에 총 784개의 반도체 소자 중에서 28개의 소자가 FPGA로부터 voltage pulse 를 입력받고, 다시 784개의 반도체 소자 중에서 10개 이상의 소자(미정)가 값을 출력하여 FPGA로 반환하는 기능을 합니다. 이때, device로의 입력 전압은 square 모양의 0.5~3V 범위의 analog pulse로 구현해야 하므로 DAC를 거쳐 출력해야하며, device의 출력 전압은 analog 값이므로 다시 ADC를 거쳐 FPGA로 반환되어야 합니다. **핵심** 따라서 FPGA-DAC-device-ADC-FPGA 순서로 data가 흘러가며, FPGA는 1us 주기로 device로 input pulse를 인가하고, 그에 따른 출력을 반환받아야 합니다. 맛비님의 강의가 제가 하려는 프로젝트의 방향성과 유사한지, 유사하다면 어떤 순서로 강의를 수강해나가야 할지 알려주신다면 정말 감사하겠습니다....!!!!!! 부디 제가 맡은 바 수행할 수 있도록 커리큘럼을 짜주신다면,, 정말 열심히 공부하도록 하겠습니다.. 학회에 발표하게 된다면 맛비님께 감사한다며 홍보도 열심히 하겠습니다..
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