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설계독학맛비's 실전 Verilog HDL Season 2 (AMBA AXI4 완전정복)

[HDL 30장] AXI4 Interface 검증환경 (환경 설명 및, 설계진행방식) - 리뷰편 2

AXI VIP 질문

561

cwj0602

작성한 질문수 1

1

안녕하세요 맛비님, 좋은 강의 잘 들었습니다.

 

다름이 아니라, 실습 파일 chapter 10 --> testbench에 있는

control_matbi_dma_ip_vip.sv

control_matbi_dma_ip_vip_pkg.sv

2개의 .sv 파일을 Vivado 상에서 생성할 수 있는지 아니면 직접 손코딩으로 설계한 것인지 여쭤보고 싶습니다.

 

감사합니다

verilog-hdl fpga 임베디드 amba

답변 1

0

설계독학맛비

안녕하세요 :)

코드리뷰를 해드린 부분은 제가 코딩에 관여했다고 보시면 될 것 같아요.

알려주신 코드를 확인해보니, Tool 을 이용해서 생성한 코드입니다.

Xilinx 에서 제공한 AXI VIP 는 문서를 보고 환경을 구축했어요.

즐공하세요 :)

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