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설계독학맛비's 실전 Verilog HDL Season 2 (AMBA AXI4 완전정복)

[HDL 37장] Mem copy IP. DMA (Direct Memory Access) 설계 - 이론편 (High performance access to DRAM, Spec review)

[HDL 37장] 질문

315

wjdtmdals29

작성한 질문수 8

1

안녕하세요 강의 매번 잘 보고있습니다!

이번 강의 초반 3분10초 쯤 데이터의 흐름에 대해 설명하시는 부분에 대해 궁금한 점이 있습니다.

펌웨어에서 변수(랜덤 혹은 실제 사용될 변수)를 생성하고 프로그램을 실행시키게 되면, 이 데이터들은 자동으로 또 우선적으로 DDR 메모리에 저장이되고 이를 PS영역에서->I/F를 통해->PL영역으로 전송이 된다고 이해하면 될까요?

 

verilog-hdl fpga 임베디드 amba

답변 1

0

설계독학맛비

안녕하세요 :)

펌웨어에서 변수(랜덤 혹은 실제 사용될 변수)를 생성하고 프로그램을 실행시키게 되면, 이 데이터들은 자동으로 또 우선적으로 DDR 메모리에 저장이되고 이를 PS영역에서->I/F를 통해->PL영역으로 전송이 된다고 이해하면 될까요?

완벽하게 정답입니다.

즐공하세요 :)

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