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설계독학맛비's 실전 Verilog HDL Season 2 (AMBA AXI4 완전정복)

[HDL 24장] Handshake I/F 의 timing closure 를 위한 skid buffer - 실습편

skid buffer 안의 m_ready 신호와 ready 신호의 차이

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=================현업자인지라 업무때문에 답변이 늦을 수 있습니다. (길어도 만 3일 안에는 꼭 답변드리려고 노력중입니다 ㅠㅠ)
  1. 강의에서 다룬 내용들의 질문들을 부탁드립니다!! (설치과정, 강의내용을 듣고 이해가 안되었던 부분들, 강의의 오류 등등)
  2. 이런 질문은 부담스러워요.. (답변거부해도 양해 부탁드려요)
    1. 개인 과제, 강의에서 다루지 않은 내용들의 궁금증 해소, 영상과 다른 접근방법 후 디버깅 요청, 고민 상담 등..
  3. 글쓰기 에티튜드를 지켜주세요 (저 포함, 다른 수강생 분들이 함께보는 공간입니다.)
    1. 서로 예의를 지키며 존중하는 문화를 만들어가요.
    2. 질문글을 보고 내용을 이해할 수 있도록 남겨주시면 답변에 큰 도움이 될 것 같아요. (상세히 작성하면 더 좋아요! )
  4. 먼저 유사한 질문이 있었는지 검색해보세요.
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================== 안녕하세요, 좋은 강의 감사합니다. skid buffer 안의 ready 신호에 대해 헷갈리는 부분이 있어 질문을 올립니다. ready 신호는 master side의 모듈이 data를 받을 준비가 되었음을 의미한다고 이해가 되며, 이는 m_ready 신호와 유사한 의미를 가진다고 생각이 됩니다. 하지만, 구현된 코드에서는 m_ready 신호와 동일한 신호로 사용하지 않는데, 두 신호의 차이를 확인할 수 있는 case가 있는지 궁금합니다.감사합니다!

답변 1

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설계독학맛비
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안녕하세요 🙂

코드 자체가 제가 생각하는 내용이기 때문에, 글로 설명하기 어려운데요. (코드가 곧.. 더 많은 정보를 내포해서)

skid buffer 안에 있는 ready 신호는, pipeline 을 위한 reg 에 data 를 latching 하기 위한 신호로 사용됩니다. m_ready 와 ready 의 신호 구분을 위한 case 는 전달드린 환경에서 random handshake 를 돌려보시고 waveform 을 보시면 확인이 가능하실 꺼에요. (두개 신호의 waveform 이 다르게 나와요. 그 차이를 이해하시면 되겠습니다)

즐공하세요 🙂

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