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해결됨

(2027 대비!) 일주일만에 합격하는 정보처리기사 실기

영상에 없는 24년도 3회차 코드 1문제 올립니다.

  • python
  • java
  • c
  • 정보처리기사
  • 정보처리산업기사
김장호 댓글 1 좋아요 0 조회수 42

다차원 배열 포인터 질문있습니다

해결됨

(2027 대비!) 일주일만에 합격하는 정보처리기사 실기

20:28에서 const char *arr[2][2]={{Hello", "World"}, {"app", "dev"}}; 이때 선언된 *arr포인터는 주소를 먹는 애로 알고 있는데, 그럼 우항의 {{Hello", "World"}, {"app", "dev"}} 이부분이 주소를 나타낸다는 뜻일까요? 추측하건대 배열이 변수 그자체로 주소를 나타내는것처럼 그것과 동일한 의미로 받아들이면 될까요? 제가 어거지로 이해해본것을 말하자면 ‘{{Hello", "World"}, {"app", "dev"}};’이 배열은 어딘가 이미선언된 k[2][2] 배열이고 k라고 우항에 쓴것과 마찬가지다..로 이해하면 되는걸까요..? ㅠ계속 이해가 안되면 그냥 문자열 배열이 들어오면 c언어의 한계때문에 선언할때 포인터를 사용한다. 이정도로만 암기하고 넘어가도 되나 싶네요 결국 선언된건 arr 이라는 배열인가요 arr이라는 포인터인가요?만약에 포인터라면 printf 할 때 arr앞에 별을 써야 해당 값이 나오는 거 아닌가요?

  • python
  • java
  • c
  • 정보처리기사
  • 정보처리산업기사
전다영 댓글 3 좋아요 0 조회수 59

원핫인코딩 전 train과 test 병합여부

해결됨

[퇴근후딴짓] 빅데이터 분석기사 실기 (작업형1,2,3)

여기선 그냥 원핫인코딩을 하셨는데, 다른 설명에선 concat으로 train 데이터와 test 데이터를 병합하고 인코딩을 해야 열 수가 같다고 하셨는데, 여기선 그냥 하셨네요 train.info(), test.info() 등으로 칼럼 이름이 같은지 확인되면 지금처럼 바로 인코딩 하면 될까요?

  • python
  • 머신러닝
  • 빅데이터
  • pandas
  • 빅데이터분석기사
YEONSUK BAE 댓글 2 좋아요 0 조회수 49

수강기간 연장

해결됨

[퇴근후딴짓] 빅데이터 분석기사 실기 (작업형1,2,3)

안녕하세요~ 13회차 실기 준비중인 수강생인데, 현재 수강중인 강의가 10월 31일 만료입니다. 그러나 13회차 실기가 11월 28일으로 시험일자까지 수강 연장이 필요합니다. ㅠㅠ 오징어게임도 수강신청했습니다. 오징어게임과 더불어 본 강의를 수강 반복해서 꼭 합격하고 싶습니다. 이번이 마지막 실기 기회여서 절박합니다. 시험일자까지 연장 가능하다면 수강기간 연장을 통해 마지막 실기에 합격하고 싶습니다. 답변부탁드립니다. yunina0314@gmail.com 감사합니다.

  • python
  • 머신러닝
  • 빅데이터
  • pandas
  • 빅데이터분석기사
비비빅 댓글 2 좋아요 0 조회수 61

NTFS LogTracker 사용법 강의

미해결

디지털포렌식 입문자를 위한 디지털포렌식 전문가 2급 실기 시험대비 강의(Encase/Autopsy)

항상 좋은 강의를 위해 노력해주셔서 감사합니다 :D '전반적인 시험과정과 놓치기 쉬운부분1' 강의를 듣던 중 강의 내용 중에 NTFS LogTracker라는 프로그램을 이용하도록 설명이 되어있습니다 포렌식 실기 과정의 기본 이론 강의는 다 들었는데 NTFS LogTracker라는 프로그램은 처음 나와서 어떤 강의에 위 프로그램 사용방법 내용이 있을까요??

  • Forensic
  • 디지털포렌식전문가-2급
tpdus8745 댓글 2 좋아요 0 조회수 53

Deployment 업데이트-2 해결 방식 문의

해결됨

Certified Kubernetes Application Developer (CKAD) – Practical Exam Guide

[👍좋은 질문을 했을 때 좋은 답변이 돌아 옵니다] 안녕하세요, 해당 문제에서 rollout resume 명령어를 사용하셨는데, 그 대신 deployment spec 에서 paused 값을 지우거나 false 로 바꾸어도 될까요?

  • 네트워크
  • kubernetes
  • devops
  • infrastructure
  • container
  • ckad
김재현 댓글 1 좋아요 1 조회수 41

코딩 살구클럽 가입 문의

해결됨

10주완성 C++ 코딩테스트 | 알고리즘 코딩테스트

강의에 있는 문제라도 볼수있게 가입승입 부탁드립니다.

  • c++
  • 코딩-테스트
parkjin37 댓글 2 좋아요 0 조회수 49

미션 진행 방식에 대한 질문입니다.

미해결

AI 시스템 디자인 실습 6주 챌린지: AI 에이전트로 백엔드 설계 실습 + 기술 면접 대비

혹시 ai-handson의 각 주차별 모듈이 구현이 완료된 상태로 제공된 것이 맞는지 확인 부탁드립니다. 지난 주차는 해설 강의를 먼저 들어서 몰랐는데, module-3의 테스트가 코드가 에이전트로 구현하기 전부터 통과하고 있었고, 4, 5 모듈도 마찬가지였습니다. 미리 구현된 상태로 제공된 것(금지 조항도 추가되어 있음)이라면 CLAUDE.md를 수정하면서 결과물을 만들어내는 것이 어려울 것 같아서요. 제가 진행 방식을 잘못 이해한 것이라면 알려주시면 감사하겠습니다.

  • kotlin
  • spring-boot
  • kubernetes
  • 아키텍처
  • kafka
  • redis
  • prometheus
xx 댓글 1 좋아요 0 조회수 54

PMI 시험신청용 영문기술경력서 작성 가이드/템플릿

미해결

혹시 별도 자료실에서 다운로드 받을 수 있는 경로가 있을까요? 시험을 신청하며 영문경력기술서 한 번에 통과될 수 있게 가이드 받고 싶습니다. 또한 오딧에 걸리지않게 (가능성이 매-우 낮아지게끔) 멘토링도 받고싶어요 :')

chungah.claire.kim 댓글 1 좋아요 0 조회수 9

메모리 리셋 관련 질문 드립니다.

미해결

설계독학's Verilog 마스터 Season 1 (실전 코딩 테스트 문제로 완성하는 디지털 설계 엔지니어의 커리어 도약)

에타님. 안녕하세요. 제가 많이 부족해서 매 강의마다 질문을 남기게 되네요... 메모리 리셋 관련된 질문입니다. [1. 질문 챕터] : L1-P16 clog2 [2. 질문 내용] : 메모리 rst에 초기화를 꼭 해야하나요? [3. 시도했던 내용, 그렇게 생각하는 이유] : 이 챕터에서 사용된 메모리는 BRAM으로 이해하고 있습니다. 두 가지 질문이 있는데요. BRAM은 따로 초기화해주지 않으면 쓰레기 값이 들어있나요? 그래서 따로 RTL에서 초기화 하고 싶은 값으로 초기화를 해줘야하나요? 만약 초기화를 따로 해줘야한다고 하면 보통 RTL 내에서 초기화를 하나요? Zynq와 같은 FPGA에서 PS로 초기화하는 방법을 사용해도 되나요? 이론에 있는 BRAM 코드를 schematic으로 보면 위처럼 나오는 반면, 모범 답안 코드의 schematic은 아래처럼 나옵니다. 초기화로 인해 로직이 추가된 것으로 보이는데 너무 비효율적으로 느껴져서 질문 드립니다.

  • verilog-hdl
  • system-verilog
김상현 댓글 2 좋아요 1 조회수 40

hooks 설정이 안되요

미해결

클로드 코드 완벽 마스터: AI 개발 워크플로우 기초부터 실전까지

현재 vs code 통해서 작업중인데, 처음에 orca 설치되어 있을때 문제가 있는듯해서 orca관련 파일등 삭제하고 진행했는데 결과가 저렇게 나오네요.

  • react
  • 인공지능(ai)
  • claude
이강훈 댓글 2 좋아요 0 조회수 47

RTL_ROM이 무엇인지 알고 싶습니다.

미해결

설계독학's Verilog 마스터 Season 1 (실전 코딩 테스트 문제로 완성하는 디지털 설계 엔지니어의 커리어 도약)

에타님, 안녕하세요. 강의 잘 보고 있습니다. [1. 질문 챕터] : L1-P15 Priority encoder [2. 질문 내용] : RTL_ROM으로 합성되었다는 것이 어떤 의미인가요? AI 답변을 봤을 때는 LUT 형식으로 합성된 것으로 이해했습니다. 이 엔코더 예제로 예를 들면 아래와 같습니다. Address 0000, 0001 , Data 00 Address 0010, 0011, Data 01 Address 0100, ..., 0111, Data10 Address 1000, ..., 1111, Data 11 만약 그렇다고 하면 게이트로 합성되는 것보다 RTL_ROM으로 합성되는게 더 유리한건가요? [3. 시도했던 내용, 그렇게 생각하는 이유] : 일단 저는 Priority encoder를 아래처럼 구현했습니다. `timescale 1ns / 1ps module priority_encoder( input [3:0] in, output reg [1:0] out, output reg valid ); //TODO always @(*) begin valid = (in == 4'b0000) ? 1'b0:1'b1; if (in[3]) out = 2'b11; else if (in[2]) out = 2'b10; else if (in[1]) out = 2'b01; else out = 2'b00; end endmodule 그 후 schematic을 보는데 valid가 RTL_ROM으로 합성되어 있어요. 모범 답안 schematic이 궁금해서 봤는데 모범 답안 schematic은 두 로직 전부 RTL_ROM으로 합성되어 있습니다. ROM으로 합성되는게 유리하다고 판단한 이유는 게이트로 합성되면 발열(전력 소모)과 전송 지연 시간 등이 있기 때문입니다. 추가로 가끔 제가 구현한 예제가 시뮬레이션 실행에도 문제가 없고 결과도 PASS로 뜨는데 schematic을 실행했을 때 에러가 발생하는 경우가 있습니다. 이 경우 실제 합성 불가능해서 schematic 실행 시 에러가 발생하는 것인가요? L1-P13 Parallel processor 내용입니다. `timescale 1ns / 1ps module clock_divider #( parameter INPUT_FREQ = 100_000_000, // 입력 주파수 (Hz) parameter OUTPUT_FREQ = 25_000_000 // 출력 주파수 (Hz) )( input wire clk_in, // 입력 클럭 input wire rst_n, // 비동기 리셋 (액티브 로우) output reg clk_out // 출력 클럭 ); // 분주 비율 계산 localparam DIVIDE_RATIO = INPUT_FREQ / OUTPUT_FREQ; localparam COUNTER_WIDTH = $clog2(DIVIDE_RATIO); // 카운터 레지스터 reg [COUNTER_WIDTH-1:0] counter; //TODO always @(posedge clk_in or negedge rst_n) begin if (!rst_n) begin clk_out <= 1'b0; end else if (counter < (DIVIDE_RATIO / 2)) begin clk_out <= 1'b1; end else begin clk_out <= 1'b0; end end always @(posedge clk_in or negedge rst_n) begin if (!rst_n) begin counter <= 1'b0; end else begin counter <= counter + 'b1; end end endmodule 어디가 문제인지 찾지는 못했습니다.

  • verilog-hdl
  • system-verilog
김상현 댓글 2 좋아요 1 조회수 44

24-2 이론 파트 재탕

해결됨

(2027 대비!) 일주일만에 합격하는 정보처리기사 실기

연결형 가상회선, 비연결형 데이터그램: 2021년 2회, 2023년 1회 문제 재탕 Control(제어)결합도: 2021년 3회 문제 재탕 반정규화(비정규화,역정규화): 2021년 1회 문제 재탕 테이블의 차수와 카디널리티 구하기: 2021년 1회 문제 재탕

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김장호 댓글 1 좋아요 1 조회수 57

모의고사 5회

해결됨

(2027 대비!) 일주일만에 합격하는 정보처리기사 실기

모의고사 5회 9번부터 문제가 없습니다. 확인해주세여

  • python
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  • 정보처리산업기사
yundevil 댓글 1 좋아요 0 조회수 46

12분 10초 func(values, 0, 1)을 넣을 때

미해결

(2027 대비!) 일주일만에 합격하는 정보처리기사 실기

12분 10초 영상에서 값이 어떻게 나오는지 보여주시지 않으셔서 QnA를 찾아보니 관련 질문이 있어 보았습니다 거기서 강사님께서는 func(values, 0, 1)을 넣을 때 a[0] + max(func(values, 0, 0), func(values, 1, 0) ) 이렇게 된다고 답변하셨는데 제가 직접 따라가보니 func(values, 0, 1)을 넣을 때 a[0] + max(func(values, 0, 0), func(values, 1, 1) ) 이렇게 나오덥니다 어떻게 a[0] + max(func(values, 0, 0), func(values, 1, 0) )이 나오는건가요? 입력된 end는 연산되는거 없이 그대로 end값이 다시 입력되는거로 되어 있는데 왜 -1되어서 들어가나요?

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Dann 댓글 1 좋아요 0 조회수 42

수업자료

미해결

2026년 CPPG 개인정보관리사 자격증 취득하기 (개정안 반영)

본 수업을 예습/복습을 하고 싶은데 수업 강의 내용이 별도 자료로는 제공이 안되나요? 보통 그냥 듣기만 하는건가요? ㅜ

  • security
  • cppg(개인정보관리사)
김정철 댓글 1 좋아요 0 조회수 51

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