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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

[HDL 17장] HW 의 동작을 제어하는 FSM 을 이해해보자. (실습응용편)

./build후 파형 볼 때 display 문제입니다.

351

경전석

작성한 질문수 4

2

=================

현업자인지라 업무때문에 답변이 늦을 수 있습니다. (길어도 만 3일 안에는 꼭 답변드리려고 노력중입니다 ㅠㅠ)

  1. 강의에서 다룬 내용들의 질문들을 부탁드립니다!! (설치과정, 강의내용을 듣고 이해가 안되었던 부분들, 강의의 오류 등등)

  2. 이런 질문은 부담스러워요.. (답변거부해도 양해 부탁드려요)

    1. 개인 과제, 강의에서 다루지 않은 내용들의 궁금증 해소, 영상과 다른 접근방법 후 디버깅 요청, 고민 상담 등..

  3. 글쓰기 에티튜드를 지켜주세요 (저 포함, 다른 수강생 분들이 함께보는 공간입니다.)

    1. 서로 예의를 지키며 존중하는 문화를 만들어가요.

    2. 질문글을 보고 내용을 이해할 수 있도록 남겨주시면 답변에 큰 도움이 될 것 같아요. (상세히 작성하면 더 좋아요! )

  4. 먼저 유사한 질문이 있었는지 검색해보세요.

  5. 잠깐! 인프런 서비스 운영 관련 문의는 1:1 문의하기를 이용해주세요.

==================

Simulation을 보기 전에 Objects에서 Name이 안뜨는 문제가 존재합니다. 오른쪽 마우스를 눌러서 Name을 뜨게 하려고 시도해도 저렇게 회색으로 선택할 수 없게 나옵니다. 뭐가 원인일까요...?

 

verilog-hdl fpga 임베디드

답변 1

1

설계독학맛비

안녕하세요 :)

Name tap 이 작은 Display 크기로 인해서 축소되어서 없는것으로 느껴지신 것 같아요.

마우스를 다음 그림의 빨간색 부분에 위치시키시고, 끌어보세요 (확장시켜보세요)

image

1

경전석

감사합니다 해결되었습니다!

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