inflearn logo
강의

강의

N
챌린지

챌린지

멘토링

멘토링

N
클립

클립

로드맵

로드맵

지식공유

설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

제공하는 실습파일 및 실행 환경에 대해 알아보아요. (수강자분들에게만 공유드려요~)

build 에러문제

348

balmont

작성한 질문수 2

1

chapter 11을 따라하다가 Build를 실행하였더니 아래와 같은 에러가 발생합니다.

제가 새롭게 파일을 작성해서 해본다고 파일은 다른것들로 대체해서 build파일을 수정햇구요

무언가 실수가 있는것 같습니다...

잡아주시면 감사하겠습니다

DUT : counter.v

TB : tb_user.v

임베디드 fpga verilog-hdl

답변 1

0

설계독학맛비

안녕하세요 :)

개인이 수정한 것들은 봐드리고 있지 않아요. 양해 부탁드립니다.

https://www.inflearn.com/news/312949

기존 build 파일과 비교해보세요.

즐공하세요 :)

 

이전에 작성했던 내용이 있는데, 참고부탁드립니다.

https://www.inflearn.com/questions/194034

git hub 404 error 도움 부탁드립니다.

0

4

1

latency 개념 구현

1

127

3

비바도 all os버전

1

96

2

초기화를 reset_n 이 '1'일 때가 아닌 '0' 일 때 실행시키는 이유 질문

1

101

2

다운로드용량

1

82

2

비바도리눅스설치

1

100

2

전체path복사넣기

1

75

2

Vivado 2025.2 리눅스 설치 후 실행 에러와 솔루션 (libxv_commontasks.so)

1

191

2

explorer.exe오류

1

121

3

mobaxterm설치오류

1

103

2

./build시, waveform 'divide color' 사용

1

62

2

Latch와 관련하여 (Time borrowing, Latch-based design)

1

153

2

clean 명령어가 안되는데, 따로 저장해줘야 하는지 궁금합니다.

0

73

1

안녕하세요 설치 관련 질문 드립니다.

1

73

3

16장 mealy 설계.

1

83

2

14장 Cycle 관련, Testbench 코드.

1

75

2

21강(16장) 초기값 설정이 적용되는 시점 질문

1

68

1

20강(15장) - 밀리 머신 관련하여 질문 드립니다.

1

77

2

build에러 질문

0

63

2

1장 ./build에서 에러가 나요

1

83

2

FPGA 강의 보드 문의 드립니다.

1

122

2

5장 DFF특성에 대한 질문

1

88

3

vivado linux 사용 이유.

1

155

2

메모리의 형태가 전체설계에 미치는 영향이 궁금합니다.

1

114

2