d_ff_test.v에 대해서 여쭙고 싶은게 있습니다!
238
작성한 질문수 5
- 먼저 유사한 질문이 있었는지 검색해보세요.
- 서로 예의를 지키며 존중하는 문화를 만들어가요.
- 잠깐! 인프런 서비스 운영 관련 문의는 1:1 문의하기를 이용해주세요.
답변 1
0
안녕하세요 :)
다음링크가 도움이 되실꺼에요. (문법은 구글링에 많이 나와요!)
https://www.javatpoint.com/verilog-assign-statement
요약하면,
assign 왼쪽 피연산자 = 오른쪽 피연산자;
상태에서,
왼쪽 피연산자는 wire (net type) 여야하구요. (reg 가 되면 안됨.)
오른쪽 피연산자는 reg, wire 상관없습니다.
즐공하세요 :)
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