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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

[HDL 5장] D FlipFlop 과 Reset 실습 (Reset 의 중요성은 여러번 말해도 됩니다.)

d_ff_test.v에 대해서 여쭙고 싶은게 있습니다!

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d_ff_test.v 에서 마지막 assign을 보면

assign o_value_sync_reset = r_ff_sync_reset ; 

assign o_value_async_reset = r_ff_async_reset ; 

assign o_value_async_reset_n = r_ff_async_reset_n;

assign o_value_mixed_reset = r_ff_mixed_reset ; 

assign o_value_no_reset = r_ff_no_reset ;

이렇게 되어 있잖아요??? 근데 저가 배우기론 assign에서 reg는 사용할 수 없다고 알고 있는데 r_ff~ 얘네들은 reg형인데 어떻게 사용이 되는건가요?

답변 1

지식공유자

안녕하세요 :)

다음링크가 도움이 되실꺼에요. (문법은 구글링에 많이 나와요!)

요약하면,

assign 왼쪽 피연산자 = 오른쪽 피연산자;

상태에서,

왼쪽 피연산자는 wire (net type) 여야하구요. (reg 가 되면 안됨.)

오른쪽 피연산자는 reg, wire 상관없습니다.

즐공하세요 :)

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