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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)
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강의를 따라하면서 편집 할때도 동일한 에러가 나서 신택스 에러라길래 원래의 파일대로 빌드 해도 같은 에러가 반복됩니다...
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저 맨 위의 u ? 는 뭐죠..?
혹여나 저 u 가 원인이라면,
침착하게 부탁드립니다 :)
감사합니다....휴먼에러가...
이러면서 알아가는거죠 ㅎ
즐공하세요 :)
감사합니다....휴먼에러가...