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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

FSM 실습편에서 vivado 질문

해결된 질문

273

움직이는YM

작성한 질문수 86

1

맛비님 vivado 관련 질문입니다
저도 맛비님처럼 c_state의 상태를 보고 싶어서 drag and drop으로 c_sate 변수를 waveform 창에 넣어 두었습니다
하지만 데이터가 어떻게 변하는지 뜨지 않았습니다.
vivado에서 어떻게 해야 c_state 처럼 테스트 벤치에 없는 변수들의 waveform을 볼 수 있는지 궁금합니다

verilog-hdl fpga 임베디드

답변 1

1

설계독학맛비

안녕하세요.

방금 그림상태에서, restart 하고 다시 run all (재생표시 ) 하시면 됩니다.

바쁘다 바뻐 현대사회.

즐공하세요 :)

0

설계독학맛비

이거 바로 전에 질문주셨던거! 답글 다시 꼭 봐주세요!!!!

0

움직이는YM

확인했습니다. 답변 감사합니다!

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