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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

[HDL 5장] D FlipFlop 과 Reset 실습 (Reset 의 중요성은 여러번 말해도 됩니다.)

reg 값 대입시 사용 심볼 "=" vs "<=" 각각의 구분 사용 방법

319

Jeongwung Jeong

작성한 질문수 6

1

test bench code 에서는 reg 값 입력을 "=" 로 작성되었구요 d_ff  코드는 reg  값 입력에 "<=" 사용 되었네요." 같은 verilog 코드인데 어떻게 구분 져서 사용 하여야 할까요?

verilog-hdl fpga 임베디드

답변 1

1

설계독학맛비

안녕하세요 :)

Testbench code 에서 inintial 안에 있는 부분을 "=" Blocking 을 사용했구요.

모듈의 D_FF 은 Clock 동기화 상태에서, 동시에 값을 변하게 하려고 "<=" Non-Blocking 을 사용했습니다.

제 설명이 이해가 안되신다면.

Verilog 의 문법 중에서.

Blocking, Non-Blocking 을 이해하시면 될 것 같아요.

이 링크가 개인적으로 정리가 잘되었다 생각이 들어요. 

https://dreamsailor.tistory.com/7

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