실습 코드 수정 관련 질문입니다!

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nosh73

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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

[HDL 1장] Testbench 에서 Clock 생성하기 ( Clock 이 없는 디지털 회로 설계를 논하지 말라. )

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안녕하세요 맛비님

올려주신 실습코드들을 Vivado 내에서 수정하고 다시 시뮬레이션을 돌려보면 변화가 없는것 같습니다.

종료 후 다시 vi에디터를 통해 코드를 수정하고 build시키면 수정한 값이 잘 나오는데

원래 Vivado 내에서 코드를 수정하면 바로 웨이브폼에 적용되지 않는건가요???

fpga 임베디드 verilog-hdl

답변 1

설계독학맛비

지식공유자

안녕하세요. 말씀해주신대로, 코드를 수정하고 build 과정을 거치셔야 합니다.

build 파일을 열어보시면, waveform 을 보기위한 단계가 기술이 되어 있습니다.

python 과 같은 반응형이 아닌, 직접 컴파일 하는 과정이 필요합니다.

불편 하실 수 있는데, waveform 을 띄우기 위한 단계를 생각해 본다면..? 어쩔 수 없음을 이해하실 것 같아요 ㅠ

여담으로, hw 설계시 simiulation time 은 오래 걸리는 과정입니다. waveform 을 띄우기위한 dump 를 받는 과정까지 추가 되면, 더욱더 오래 걸립니다. 그래서 효과적 (시간 + 기능)으로 검증하기 위한 검증 엔지니어도 존재하고 돈? 도 많이 버세요.

즐공입니다 :)

nosh73

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