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FPGA에 UART 구현하기

UART TX/RX 모듈 RTL 설계 및 시뮬레이션

RTL

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21

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RTL이 Veliog인거같은데 vhdl 버전은 없나요 ?

답변 1

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지식공유자

안녕하세요.

본 강의는 system-verilog 기반으로 하고 있습니다. 해당 코드를 AI를 이용해서 VHDL로 변환 후, 약간만 수정하면, VHDL 코드도 생성하실 수 있을 것 같습니다. 강의 마지막에 제가 생성한 uart_tx.vhd 파일을 추가시켜 놓겠습니다. 시뮬레이션 해서, 기존 uart_tx.sv 파일과 비교해보시면 좋겠습니다.

감사합니다.

 

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