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미해결설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)
Vivado 시뮬레이션 디버깅 관련 질문
안녕하세요 맛비님, 현재 Verilog Season1 17강 수강중입니다!다름이 아니라, ./build를 통해, Vivado 시뮬레이션을 실행한 후, waveform을 "step"별로 code 의 flow로 확인하고 싶어, "Step키(F8)"를 사용하려 했는데, 연한 회색으로 사용 불가능 표시가 떠있더라구요.... 구글링을 통해 해결방법을 찾는 중이긴 합니다만, 원하는 자료가 잘 나오지 않아서 이렇게 질문 남깁니다 ㅠㅠ혹시, Vivado 시뮬레이션창에서, Step(F8) 키를 활성화시키는 방법을 알고 계신지 궁금합니다!
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미해결설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)
Clock 시뮬레이션 결과 관련 문의
안녕하세요 맛비님 강의 잘 듣고 있습니다. Clock 신호 생성을 테스트해보고 있는데 #100 finish 구문을 넣었음에도 waveform 이 100ns 에 끝나지 않고 계속 생성되네요. 무엇이 문제일까요? <코드><Waveform>감사합니다.