맛비님 강의PDF나 PPT자료는 혹시 구할 수 있나요?
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작성한 질문수 1
답변 1
Arty z7 -20 보드의 경우
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RVALID/RREADY 핸드셰이크 발생 시 RDATA 전이가 발생해도 문제가 없는 이유?
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수강 순서 질문 있습니다
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UART의 역할이 PC와 PS를 연결해 주는 역할로 알고 있습니다.
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HW가속기 설계에서 더 보완할 수 있는 방법이 있을까요?
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UART0, 1 중 선택
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datamoverbram모듈질문
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vitis 설치엣 alveo kria versal 등 옵션을 끄고 설치를 했습니다.
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vitis 설치 관련 질문 있습니다!
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181
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FPGA 공식문서 읽는법
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171
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보드 추가의 클릭창이 없습니다.
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Edit in IP Packager에서 코드 수정 후 IP 수정하면 simulation에서 수정된 코드로 작동이 안됩니다
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BRAM의 Read / Write를 다 수행했는지 확인할 때 사용되는 num_cnt / i_num_cnt 관련 질문
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Vitis 코드 작성
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vivado 및 vitis 리눅스 환경 설치 관련 질문드립니다.
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388
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[9장 led 점등 시간 제어 불가]
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154
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Platform Invalid 오류
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274
3
WSL 설치 관련 문의드립니다!!
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148
2
Vivado 툴, 파일 질문드립니다!
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258
2
9장 LED 점등 안됨
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193
3
Edit in IP Packager 이후에
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140
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Fpga 로직
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151
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pmu-fw is not running
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245
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Create Project에 대해서 궁금해요
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