Zynq z7 FPGA single-ended 관련
안녕하세요.
유익한 강의 올려주셔서 많은 배움 얻고 있습니다.
다름이 아니라 LED Blinking 프로젝트 관련하여 문의 드립니다.
제가 사용 중인 FPGA 보드(Zybo Z7-20)의 경우 125MHz single-ended 클럭만 지원하여, 아래와 같이 수정하여 진행하고 있습니다.
IBUFDS 제거 (differential 클럭 미지원)
MAX_COUNT를 125,000,000으로 변경
counter 비트폭을 28bit → 27bit로 축소
이렇게 진행해도 문제가 없는지 확인 부탁드립니다.
감사합니다.
回答 1
1
네, 정확한 내용인 것 같습니다. 추가로 말씀드리면, PLL/MMCM을 사용해서 200MHz clock을 생성하면, 나머지 부분은 수정하지 않아도 될 것 같습니다.
uvm config db에 대해 궁금한 점이 있습니다.
0
7
1
이 강의 zboz7보드에서도 실행 가능한가요?
1
33
1
강의자료 기한 연장 + 로드맵 문의
0
30
2
Chapter 16 FSM 관련 질문
1
42
2
강의 환경(linux) 관련 질문
1
49
2
강의자료 업로드 될까요
0
36
2
output.txt가 이상하게 나옵니다.
1
43
2
L2_P08 SRAM 코드 리뷰 부탁드립니다.
1
35
2
Arty Z10 관련 문의
1
46
2
season 2 코딩테스트 강의에 대한 문의드립니다.
1
44
1
4:1먹스 구현방식에 대한 질문입니다.
1
39
2
수강 순서 질문 있습니다
1
69
2
Windows 기능 켜기
1
62
2
cache에서 data miss가 나고 메모리에서 read data할때 이해가 안가는 신호가 있어서 질문 드립니다.
0
51
1
[L1-P02] 멀티플렉서 실전 결과 확인하는데 시간이 너무 걸립니다.
0
46
2
13장 파이프라인 질문 드립니다.
1
87
2
UART의 역할이 PC와 PS를 연결해 주는 역할로 알고 있습니다.
1
80
2
L2_P4 data_average 코드 리뷰 및 waveform 질문 드립니다.
1
66
2
Ubuntu 20.04.5 설치관련 문의드립니다
1
95
2
LV2-2 Patter Detector code review 부탁드립니다.
1
45
1
환경 설정하는 guide 최신화 부탁드립니다.
1
81
2
Arty A7-35T 구매 불가
0
58
2
fpga 개발보드
0
79
2
vivado 설치 관련하여 질문 합니다.
0
172
2