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개발 · 프로그래밍

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Verilog FPGA Program 6 - DDR Arbiter (HIL-A35T)

본 강의는 DDR Memory Arbiter를 구현합니다.

2명 이 수강하고 있어요.

Verilog HDLFPGA

초급자를 위해 준비한
[Verilog HDL, 텍스트 강의] 강의입니다.

이런 걸 배울 수 있어요

  • DDR Arbiter

  • Image Frame Buffer

본 강의는 DDR Memory Controller의 마지막 단계인 Arbiter를 구현하는 내용입니다. ddr을 Image 데이터를 위한 frame buffer로 사용할 때, ddr access (read/write)가 겹치는 경우가 있습니다. 주로 입력과 출력의 Frame Rate이 다른 경우에 발생합니다. 이러한 경우에는 Arbiter를 설계해서 Access (Read/Write) Timing을 조절해 주어야 합니다. read, write request을 순차적으로 처리할 수 있도록 해야 합니다.

본 강의는 입력 Image의 Frame Rate와 출력 Image의 Frame Rate 가 다른 경우에, ddr Arbiter를 구현하여 ddr access가겹치지 않고 순차적으로 이루어질 수 있도록 구현합니다. 결과를 보드에 다운로드 하고 정상적으로 동작하는 것을 확인할 것입니다.

본문의 구성은 다음과 같습니다.

2장은 실습에 사용되는 HIL-A35T 보드에 대해서 설명합니다.

3장은 대략적인 시스템 구성에 대해 설명합니다.

4장은 모듈별로 프로그램을 구현합니다.

5장은 Top Module을 구현하고, Simulation으로 결과를 확인합니다.

6장은 Bitstream을 생성하고 결과를 보드에서 확인합니다.

💾 수강 전 확인해주세요!

  • 본 강의는 PDF 형태의 텍스트 강의로, 별도 영상을 제공하지 않습니다.

  • 강의에 설명된 모드 소스 코드를 제공하여 드립니다.

  • 자사에서 판매하는 HIL-A35T 개발 보드에서 실습을 진행합니다.

지식공유자 소개 ✒

저는 20여 년 동안 대기업, 중소기업에서 개발자로 일해왔고 현재는 작은 기업을 운영하고 있습니다. CCTV용 ISP(Image Signal Processing) ASIC을 개발하였고 OLED 검사 장비, DAQ (Data Acquisition System) 등 FPGA를 이용한 많은 제품을 개발하였습니다. FPGA뿐만 아니라 FW 개발 (STM32, PIC32, AVR, ATMEGA 등), 회로 설계, Windows Program 등 많은 경험을 갖고 있습니다. 그동안 제가 쌓아온 폭넓은 경험을 바탕으로 여러분의 학습에 도움이 되기를 소망합니다.

이런 분들께
추천드려요!

학습 대상은
누구일까요?

  • Verilog 배우고 싶은신 분

  • FPGA 배우고 싶으신 분

  • ddr Arbiter 배우고 싶으신 분

선수 지식,
필요할까요?

  • verilog

  • vivado

  • xilinx fpga

안녕하세요
입니다.

1,576

명

수강생

62

개

수강평

120

개

답변

4.8

점

강의 평점

19

개

강의

저는 지난 20여년 동안 대기업, 중소기업에서 개발자로 일해왔고

현재는 작은 기업의 대표로 있습니다.

주요 경력사항은

  • Verilog HDL을 이용한 FPGA 설계

    • CCTV용 ISP ASIC 개발 (약 10년)

    • OLED Display 검사장비 개발 (약 3년)

    • FPGA를 이용한 장비 개발

  • MCU FW

    • STM32

    • PIC32

    • AVR, ATMEGA

    • DSP (TI)

  • Windows Application Program

    • Visual Studio MFC, C++

입니다.

커리큘럼

전체

104개

해당 강의에서 제공:

수업자료
강의 게시일: 
마지막 업데이트일: 

수강평

아직 충분한 평가를 받지 못한 강의입니다.
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