Verilog FPGA Program 6 (ddr Arbiter)

Name: Verilog FPGA Program 6 (ddr Arbiter)
Price: 110000 KRW
Rating: 5 (3 reviews)

본 강의는 DDR Memory Arbiter를 구현합니다.

(5.0) 수강평 3개

수강생 12명

난이도 초급

수강기한 무제한

alex

ddrarbiter구현

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FPGA

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수강 후 이런걸 얻을 수 있어요

DDR Arbiter
Image Frame Buffer

본 강의는 DDR Memory Controller의 마지막 단계인 Arbiter를 구현하는 내용입니다. ddr을 Image 데이터를 위한 frame buffer로 사용할 때, ddr access (read/write)가 겹치는 경우가 있습니다. 주로 입력과 출력의 Frame Rate이 다른 경우에 발생합니다. 이러한 경우에는 Arbiter를 설계해서 Access (Read/Write) Timing을 조절해 주어야 합니다. read, write request을 순차적으로 처리할 수 있도록 해야 합니다.

본 강의는 입력 Image의 Frame Rate와 출력 Image의 Frame Rate 가 다른 경우에, ddr Arbiter를 구현하여 ddr access가겹치지 않고 순차적으로 이루어질 수 있도록 구현합니다. 결과를 보드에 다운로드 하고 정상적으로 동작하는 것을 확인할 것입니다.

본문의 구성은 다음과 같습니다.

2장은 실습에 사용되는 Arty A7-35T 보드에 대해서 설명합니다.

3장은 대략적인 시스템 구성에 대해 설명합니다.

4장은 모듈별로 프로그램을 구현합니다.

5장은 Top Module을 구현하고, Simulation으로 결과를 확인합니다.

6장은 Bitstream을 생성하고 결과를 보드에서 확인합니다.

💾 수강 전 확인해주세요!

본 강의는 PDF 형태의 텍스트 강의로, 별도 영상을 제공하지 않습니다.
강의에 설명된 모드 소스 코드를 제공하여 드립니다.
본 강의는 Digilent 사에서 판매하는 Arty A7 보드와 자사에서 판매하는 HIL-A35T 보드에서 실습을 진행합니다
HIL-A35T 보드는 자사에서 운영하는 스마트 스토어에서 구매할 수 있습니다(스마트 스토어 링크 : https://smartstore.naver.com/ihil)
강의 자료는 '섹션 0 - 자료 공유 링크 - 첨부파일'에서 다운받을 수 있습니다.

지식공유자 소개 ✒

저는 20여 년 동안 대기업, 중소기업에서 개발자로 일해왔고 현재는 작은 기업을 운영하고 있습니다. CCTV용 ISP(Image Signal Processing) ASIC을 개발하였고 OLED 검사 장비, DAQ (Data Acquisition System) 등 FPGA를 이용한 많은 제품을 개발하였습니다. FPGA뿐만 아니라 FW 개발 (STM32, PIC32, AVR, ATMEGA 등), 회로 설계, Windows Program 등 많은 경험을 갖고 있습니다. 그동안 제가 쌓아온 폭넓은 경험을 바탕으로 여러분의 학습에 도움이 되기를 소망합니다.

이런 분들께
추천드려요

학습 대상은
누구일까요?

Verilog 배우고 싶은신 분
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ddr Arbiter 배우고 싶으신 분

선수 지식,
필요할까요?

verilog
vivado
xilinx fpga

안녕하세요
alex입니다.

커리어인증

1,791

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수강생

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수강평

134

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답변

4.8

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강의 평점

개

강의

저는 지난 20여년 동안 대기업, 중소기업에서 개발자로 일해왔고

현재는 작은 기업의 대표로 있습니다.

주요 경력사항은

Verilog HDL을 이용한 FPGA 설계
- CCTV용 ISP ASIC 개발 (약 10년)
- OLED Display 검사장비 개발 (약 3년)
- FPGA를 이용한 장비 개발
MCU FW
- STM32
- PIC32
- AVR, ATMEGA
- DSP (TI)
Windows Application Program
- Visual Studio MFC, C++

입니다.

커리큘럼

전체

103개

해당 강의에서 제공:

수업자료

섹션 1. 개요

4개

섹션 2. HW 구성

4개

5. HW 구성 - 0
6. HW 구성 - 6
7. HW 구성 - 7
8. HW 구성 - 8

섹션 3. 시스템 구성

3개

섹션 4. 프로그램 구현

69개

섹션 5. Top Module 구현

13개

섹션 6. Bitstream 생성 및 결과 확인

8개

섹션 7. 기타

2개

강의 게시일: 2025. 06. 03.

마지막 업데이트일: 2025. 06. 15.

수강평

전체

3개

5.0

3개의 수강평

mjs1004
수강평 5
∙
평균 평점 5.0
2026. 05. 04.
5
100% 수강 후 작성
정말 도움이 되는 강의 감사합니다!
haneuli
수강평 15
∙
평균 평점 5.0
2025. 06. 04.
5
31% 수강 후 작성
김민겸
수강평 6
∙
평균 평점 4.7
2026. 05. 22.
5
30% 수강 후 작성

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