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PCB HW설계 실무 : STM32를 활용한 Mixed-signal 보드 설계 프로젝트

회로설계의 경쟁력, 결국 넓은 Domain 경험이 핵심입니다! STM32 MCU, Ethernet PHY, Motor Driver, ADC/DAC, EMI, ESD 등 모든 HW지식과 경험을 한 번에 해결해보세요!

(5.0) 수강평 153개

수강생 707명

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새소식

4 개

  • 안녕하세요. 삼코치입니다.

    강의를 들어 주신 분들께 먼저 알려 드리고 싶은 소식이 있어서 글을 씁니다.


    아날로그 회로설계 기본기 트레이닝 보기


    아날로그 회로설계 기본기 트레이닝

    질문 게시판에서 시작했습니다

    강의를 올린 뒤로 질문 게시판에 남겨 주신 글에 답을 달아 왔습니다.

    • L 만 키웠는데 gain 이 생각처럼 안 나와요

    • slew rate 가 말이 안 되게 크게 나옵니다

    • PSRR 이 10 dB 도 안 나와요

    • spec 은 처음에 어떻게 정하나요?

    답글로 원인을 적어 드릴 수는 있었습니다. 그런데 쓰면서 늘 아쉬웠습니다.

    그 숫자가 왜 나왔는지는 회로를 다시 돌려서 내 눈으로 확인해야 이해가 되는데, 그 경험은 답글로 드릴 수가 없었으니까요.


    schematic 위에 gm 과 id 가 찍힌 xschem 화면

    Lab 1 · xschem 에서 돌린 operating point 가 schematic 위에 바로 찍힌 화면입니다. gm 과 id 를 표로 옮기지 않고 회로 위에서 읽습니다.

    회사에서 아날로그 IP 를 설계할 때도 그랬습니다. 손으로 계산한 값과 simulation 값이 다르면, 그 차이가 어디서 왔는지 찾을 때까지 다음 단계로 가지 않았습니다.

    block 을 넘기기 전에는 corner 와 Monte Carlo 를 모두 돌려 spec 표를 채웠고, 동료가 그 표를 다시 돌려 봤습니다. 강의에서는 이 과정을 제 화면으로 보여 드렸지만, 직접 몇 번 해 봐야 익숙해지는 일입니다.

    그래서 이번에는 제 화면 대신 여러분 PC 에서 돌리는 실습을 만들었습니다. 아날로그 회로설계 기본기 트레이닝입니다.


    강의와 무엇이 다른가요

    지금까지 강의에서는 주로 LTspice 에 TSMC 180 nm library 를 얹어 썼습니다. 이번 실습은 xschem · ngspice 와 sky130 으로 바꿨습니다.


    xschem 에서 연 2-stage OPAMP loop testbench

    Lab 15 · 2-stage OPAMP 의 loop testbench 를 xschem 에서 연 화면입니다. sky130 의 nfet_01v8 · pfet_01v8 로 그렸습니다.

    모두 open source 라 license 없이 누구나 설치할 수 있습니다. sky130 은 실제 공정을 공개한 PDK 라서 corner model 과 Monte Carlo model 이 들어 있고, design rule 도 있어서 layout 을 실제 크기로 볼 수 있습니다.


    2-stage OPAMP 의 KLayout 화면

    같은 OPAMP 를 sky130 design rule 로 그린 KLayout 화면입니다. 오른쪽 큰 사각형이 compensation capacitor Cc 입니다.

    45 corner 와 Monte Carlo 도 내 PC 에서 돌립니다.


    Monte Carlo 1000번으로 본 input pair offset

    Lab 17 · input pair 의 mismatch 로 생기는 offset 을 Monte Carlo 1000번 돌린 ngspice 화면입니다. 점 하나가 run 하나입니다.

    회사에 가서 Virtuoso · ADE 를 쓰게 될 분을 위해, 같은 작업을 Cadence 에서는 어디서 하는지 나란히 적은 안내도 넣었습니다.


    Lab 하나는 이렇게 진행됩니다

    Lab 마다 순서는 같습니다. 결과를 먼저 예측해서 적고, 돌려 보고, 내 예측이 얼마나 맞았는지 봅니다.


    Lab 1 의 첫 질문 화면

    Lab 1 의 첫 질문입니다. Vds 를 0.3 V 에서 1.2 V 로 4배 올리면 Id 는 몇 % 늘어날까요? 답을 보기 전에 내 숫자를 먼저 적습니다.

    예측은 한 번 저장하면 고칠 수 없습니다. 틀린 숫자가 남아 있어야 어디서 틀렸는지 찾게 되거든요.

    앞에 적은 질문들도 실습 안에 들어 있습니다.

    • L 만 키운 회로는 Lab 5 에서 다시 돌려 봅니다

    • slew rate 를 무엇이 정하는지는 Lab 15

    • PSRR 을 어떻게 적고 어떻게 돌리는지는 Lab 19

    • spec 에서 W 와 current 를 정하는 순서는 Lab 9 에서 처음부터 해 봅니다

    transistor 하나에서 시작해 CS amp, diff pair, current mirror 를 지나 2-stage OPAMP 를 설계합니다. 마지막에는 동료가 넘긴 block 을 checklist 대로 다시 돌려 보는 design review 로 끝납니다. Level 넷에 Lab 23 개입니다.

    Level 이 끝날 때마다 Level check 가 있습니다. 처음 보는 spec 을 받아 W · L · current 를 정하면 check script 가 spec 항목마다 채점하고, 다시 풀면 spec 이 새로 나옵니다. 답을 외워서는 통과할 수 없게 만들었습니다.

    Level 3 을 마치면 SAR ADC · PLL · DC-DC 에 들어가는 block 을 transistor 수준에서 돌려 보는 Project prep 셋이 이어집니다.


    SAR ADC core 의 KLayout 화면

    Project prep 1 · SAR ADC core 의 CDAC · comparator · switch 를 sky130 design rule 로 그린 KLayout 화면입니다.


    결제 전에 무료로 해 볼 수 있습니다

    처음 세 화면은 회원가입하고 로그인만 하면 무료입니다.

    • Start check · 내 PC 에 tool 을 설치하고 기준 숫자가 맞게 나오는지 확인합니다

    • Lab 1 · transistor 하나를 돌려 operating point 를 schematic 위에서 읽습니다

    • Simulation guide · 실습에서 쓰는 ngspice 명령과 error 문구 사전입니다


    Lab 1 의 region 그림

    Lab 1 의 region 그림입니다. Vgs 와 Vds 에 따라 transistor 가 어느 region 에 있는지 한 장에 칠했습니다. Lab 1 은 무료라 이 그림을 직접 움직여 볼 수 있습니다.

    Windows 10 · 11 PC 에 disk 30 GB, memory 8 GB 이상이면 됩니다. 내 PC 에서 되는지는 Start check 로 먼저 확인해 보세요.

    실습하다가 tool 이 멈추거나 숫자가 다르게 나오면 단계마다 있는 "문의하기"로 물어봐 주세요. 어느 Lab 몇 단계인지 저절로 붙어서 오니, 상황을 처음부터 설명하지 않으셔도 됩니다.

    구성과 실제 화면은 여기서 보실 수 있습니다.


    아날로그 회로설계 기본기 트레이닝 보기




    Digital · Layout · Verification · Implementation · HW board · Embedded 기본기도 같은 방식으로 만들고 있습니다. 하나씩 열 때마다 다시 소식 드리겠습니다.

    질문을 남겨 주신 분들 덕분에 무엇을 실습으로 만들어야 할지 알 수 있었습니다. 고맙습니다. 질문 게시판은 앞으로도 계속 보겠습니다.


    삼코치 드림

    0
  • 안녕하세요, 회로설계 멘토 삼코치 입니다.

     

    요즘 주식과 산업 모두에서 AI 반도체가 가장 뜨거운 키워드죠.
    그 흐름 속에서 제가 준비한 “AI 반도체 설계 강의”가
    드디어 고용노동부 국비지원 심사를 통과했습니다!

    👉지금 바로 신청하기

     

    🔹 AI 반도체가 산업의 중심이 되다

    최근 AI 산업의 성장 속도는 상상을 초월합니다.
    GPT, Llama, Claude 같은 초거대 언어모델이 등장하며
    산업 전반의 연산 구조 자체가 재정의되고 있습니다.

    그 중심에는 AI 반도체(AI Accelerator) 가 있습니다.
    AI가 아무리 발전해도,
    그 연산을 담당할 반도체 구조가 이를 따라가지 못하면
    결국 속도와 효율은 한계에 부딪힙니다.

    그래서 지금, 전 세계가 AI 반도체 설계 인력 확보에 나서고 있습니다.
    삼성, 하이닉스, 엔비디아, AMD뿐 아니라
    국내 스타트업, 팹리스, 연구소까지
    모두 “연산 효율을 구조적으로 설계할 줄 아는 사람”을 찾고 있습니다.


    🔸 GPU 이후, 새로운 구조 경쟁의 시대

    현업에서는 지금 GPU 기반 연산의 한계를 넘기 위한
    다양한 설계 혁신이 동시에 진행되고 있습니다.

    • 칩렛(Chiplet) 아키텍처: 대형 칩을 여러 개의 모듈로 나눠 설계함으로써,
      제조 공정 제약을 줄이고 발열과 수율 문제를 개선하는 접근입니다.

    • HBM(High Bandwidth Memory) 통합:
      AI 모델 학습의 병목 지점인 메모리 대역폭 문제를 해결하기 위해
      HBM을 직접 적층하고, 연산 유닛과 인터페이스를 최소화하는 기술이 주목받고 있습니다.

    • 3D 적층(3D Stacking):
      GPU보다 훨씬 높은 연산 밀도를 확보하기 위해
      논리칩과 메모리칩을 수직으로 적층하여 신호 지연을 줄이는 방식입니다.

    이러한 기술들이 하나로 묶이며,
    결국 AI 반도체의 핵심은 “효율적인 연산 구조를 설계하는 능력”으로 수렴됩니다.


    🔸 회로설계자가 익혀야 할 세 가지 축

    ① 공통 실무 역량
    Verilog/SystemVerilog로 RTL 설계를 수행하고,
    FPGA를 통해 실제 회로를 구현하며,
    타이밍 제약과 전력, 신호 무결성을 맞춰가는 과정은
    모든 설계자의 기본기이자 ‘회로의 언어’입니다.
    이건 더 이상 선택이 아니라 필수입니다.

    ② 전문 설계 영역의 심화
    진로에 따라 설계의 깊이가 달라집니다.
    전력 반도체 분야에서는 GaN 기반 전원 회로나
    3레벨 스위칭 차저 같은 고효율 회로 설계를,
    디지털 설계 분야에서는 DDR, PCIe, SerDes 같은
    고속 인터페이스 설계 및 Verification 환경 구축을 다룹니다.
    이건 단순히 배우는 게 아니라 직접 설계하고 검증해야만 이해할 수 있는 영역입니다.

    ③ 산업을 주도하는 트렌디한 기술들
    칩렛, 3D 적층, AI 기반 EDA,
    HBM 메모리 통합, 그리고 AI 가속기 구조 설계.
    이 다섯 가지가 바로 지금 산업의 미래를 결정짓는 기술입니다.


    ⚙ 이론이 아닌 “실제 설계 사고력”을 배우는 과정

    이 세 가지 축을 실무적으로 연결하기 위해
    제가 직접 구성한 “AI 반도체 설계 실무” 과정이
    이번에 고용노동부 K-디지털 기초역량훈련에 정식 승인되었습니다.

    이 과정은 단순히 “배우는 강의”가 아닙니다.
    “설계자의 사고 방식을 익히는 훈련”입니다.

    • Verilog로 연산 블록을 직접 설계하고

    • CPU 아키텍처를 구현하며

    • 마지막에는 AI 연산 유닛을 추가해 AI 가속기 구조를 완성합니다.

    과정 전체는 “왜 이 구조가 효율적인가?”,
    “실제 칩 설계에서 어떤 제약을 고려해야 하는가?”,
    “이 신호 타이밍은 왜 이렇게 잡히는가?”를 끊임없이 질문하며 진행됩니다.

    과제를 제출하면 단순히 점수를 주는 게 아니라,
    현업 엔지니어 시선에서 실제 Tape-out 단계에서의 문제까지 짚어드립니다.

    “이 구조는 Hold Violation이 발생할 수 있습니다.”
    “이 타이밍은 FPGA 환경에선 통과해도 실제 ASIC에서는 실패할 가능성이 높습니다.”

    이런 피드백이 바로 ‘실무형 설계 감각’을 만드는 순간입니다.


    👨‍🏫 운영 구조 및 지원 체계

    • 운영 플랫폼: 코멘토(COMENTO)

    • 강사진 구성:

      • 주 강사 1인(삼성전자 S.LSI 출신 반도체 회로설계 엔지니어 - 삼코치)

      • 보조 강사 2인(현직 회로설계 엔지니어)

    • 지원 방식:

      • 실시간 질의응답 및 프로젝트별 피드백

      • 심화 학습 자료, 설계 트렌드 리포트 제공

      • AI 반도체 공모전 수상작 분석 세션 운영

      • 최신 산업 포지션 분석 및 커리어 Q&A 세션 제공

    이 시스템은 단순 학습이 아니라,
    실무 감각 → 포트폴리오 구축 → 커리어 확장으로 이어지는 구조로 설계되었습니다.


    💰 국비지원 혜택 및 수료 특전

    본 과정은 고용노동부 K-디지털 기초역량훈련 사업을 통해
    수강료의 90% 이상이 국비로 지원됩니다.
    실제 자비부담금은 약 4만 2천 원 수준입니다.

    • 공식 수료증 (NCS 코드 포함) 발급

    • 평생 수강권 제공 (업데이트 포함)

    • 코멘토 현직자 커뮤니티 6개월 이용권
      → 현업 설계자 및 수강생 간 기술 질의, 취업 정보 공유 가능

    • AI 공모전 트렌드 리포트 및 수상작 분석 콘텐츠 제공

    • AI 반도체 취업/이직 정보 채널 연계 지원

    이 과정은 원래 40~50만 원대의 실습형 커리큘럼이지만,
    국비지원 덕분에 거의 무료로 수강할 수 있습니다.

     

    다만 예산이 한정되어 있어
    기수별 선착순 마감으로 운영됩니다.

    또한 국비지원의 특성상, 지원이 언제 마감될 지 모릅니다.

    수강 혜택은 동일하게 유지되기 때문에
    고민하지 말고 신청할 수 있을 때 신청해주시기 바랍니다.

    (실제로 23년도까지 100% 무료였는데, 2024년에 90%로 바뀌어었습니다.)

     

    👉지금 바로 신청하기


    🚀 수료 이후의 확장: 커리어 & 공모전

    이 과정을 마친 수강생은 단순히 “AI 반도체를 배운 사람”이 아닙니다.
    AI 반도체 공모전, 설계 인턴십, 반도체 기업 취업 준비 등
    실제 커리어 단계로 연결되는 실무 역량 기반 인재가 됩니다.

    • AI 반도체 공모전 참여 준비반 운영
      → 실제 수상작 구조 분석, 제출 회로 설계 피드백 제공

    • 취업 및 이직 지원 콘텐츠 제공
      → 채용 트렌드, 포지션 분석, 기업별 설계 역량 가이드

    • 커뮤니티 네트워킹
      → 수료생 간 스터디, 공동 프로젝트 및 정보 교류 지원

    즉, 학습의 끝이 아니라
    ‘AI 반도체 설계자로서 커리어를 구체화하는 출발점’이 됩니다.


    AI 반도체 산업은 단순히 반도체의 한 분야가 아닙니다.
    AI, 시스템, 반도체가 융합된 새로운 기술 생태계의 중심입니다.
    이제 회로설계자는 단순히 “칩을 설계하는 사람”이 아니라,
    “AI 연산 구조를 설계하는 엔지니어”가 되어야 합니다.

    이번 국비지원 과정을 통해
    실제 산업 수준의 설계 감각을 익히고,
    AI 반도체 시대를 주도할 수 있는 실무형 인재로 성장해보시길 바랍니다.

    감사합니다.

     

    회로설계 멘토 삼코치 드림.

    0
  • (무료 자료 링크 오발송으로 다시 전달드립니다.)

     

    회로설계 취업 준비생 여러분, 안녕하세요.

    요즘 채용 시장을 보면,
    공채는 줄고, 소수 정예로 포지션을 채용하는 흐름이 뚜렷합니다.
    특히 디지털 설계만 준비했던 분들은 "내가 이 방향으로 괜찮을까?"라는 고민이 깊어지는 시기이기도 합니다.

    저 또한 현업과 교육 현장에서 많은 분들을 만나며,
    '정보는 많은데, 내게 맞는 방향을 찾는 건 여전히 어렵다'는 이야기를 자주 들었습니다.

    그래서 이번에,
    정확한 방향성과 실제 준비 방법을 제공하는 세미나를 준비했습니다.

    이번 세미나는
    단순한 정보 전달이 아니라,
    "여러분 한 분 한 분이, 자신의 위치를 정확히 점검하고 다음 단계를 그릴 수 있도록"
    실질적인 도움을 드리기 위해 기획했습니다.


    ✅세미나: 2025 회로설계 취업 전략 세미나
    👉세미나 신청하기

    구성 내용은 다음과 같습니다.

    • 각 산업별 회로설계 직무 채용 흐름 분석

    • 디지털+아날로그+검증+시스템 통합 경험의 중요성

    • 실제 취업/이직 성공 사례 공유

    • 짧은 시간 안에 실무 경쟁력을 높이는 방법

    • 자유 Q&A (채용, 이직, 공부 방향 모든 질문 환영)


    🎁세미나 참여자 전원 제공 혜택

    • 회로설계 진입을 위한 무료 PDF 전자책

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    (참석만 하셔도, 준비에 꼭 필요한 자료를 받아가실 수 있도록 준비했습니다.)


    🎯추가 자료 및 특별 혜택도 함께 드립니다

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    📢추가로, 이번에 꼭 함께 보셨으면 하는 영상도 준비했습니다.

    2025 반도체 회로설계 취업, 이렇게 준비해야 합니다

    디지털 설계만으로는 부족합니다.
    이제는 디지털과 아날로그 통합 경험을 갖춘 인재를 기업들이 찾고 있습니다.

    이 영상에서는

    • 채용담당자와 현직자 인터뷰를 통해 얻은 생생한 인사이트

    • 회로설계 5대 직무별 준비 방향

    • T자형 인재 전략

    • 추천 포트폴리오 구성 방법

    • 9개월 취업 준비 로드맵

    을 모두 구체적으로 정리했습니다.

    📺영상 바로 보기
    👉https://www.youtube.com/watch?v=a8-_rZENV9c

    (※ 이 영상은 세미나 신청 여부와 관계없이 누구나 무료로 시청하실 수 있습니다.)


    이번 세미나는
    "정보만 쌓고 답답함이 더해지는 준비"가 아니라,
    "방향을 명확히 하고, 실제로 움직일 수 있게 만드는 준비" 를 돕기 위해 만들었습니다.

    지금 혼자만의 고민 속에 계시다면,
    이번 세미나를 통해 명확한 길을 찾아가실 수 있도록 돕겠습니다.

    부담 없이 참석하시고,
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    함께 성장하는 시간이 되기를 진심으로 기대하겠습니다.
    감사합니다.

     

    삼코치 드림.

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    회로설계 취업 준비생 여러분, 안녕하세요.

    요즘 채용 시장을 보면,
    공채는 줄고, 소수 정예로 포지션을 채용하는 흐름이 뚜렷합니다.
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