Verilog HDL Season 2 강의 오픈 일정 관련 문의 입니다!
295
작성한 질문수 16
저는 지금 맛비님의 커리큘럼을 거의 전부 수강 하고 있고,
강의를 통해서 정말 많은 도움 받고 있습니다.
그래서 설계독학맛비님의 Verilog HDL Season 2 강의 오픈하면 수강 하려고 기다리고 있었는데, 6월 16일에 오픈 하는거 맞나요? ㅎㅎ
수강 순서 질문 있습니다
1
73
2
UART의 역할이 PC와 PS를 연결해 주는 역할로 알고 있습니다.
1
84
2
HW가속기 설계에서 더 보완할 수 있는 방법이 있을까요?
1
91
2
UART0, 1 중 선택
1
124
2
datamoverbram모듈질문
1
99
2
vitis 설치엣 alveo kria versal 등 옵션을 끄고 설치를 했습니다.
1
150
2
vitis 설치 관련 질문 있습니다!
1
152
2
FPGA 공식문서 읽는법
1
150
2
보드 추가의 클릭창이 없습니다.
1
117
2
Edit in IP Packager에서 코드 수정 후 IP 수정하면 simulation에서 수정된 코드로 작동이 안됩니다
1
151
2
BRAM의 Read / Write를 다 수행했는지 확인할 때 사용되는 num_cnt / i_num_cnt 관련 질문
1
141
1
Vitis 코드 작성
1
170
2
vivado 및 vitis 리눅스 환경 설치 관련 질문드립니다.
1
363
3
[9장 led 점등 시간 제어 불가]
1
128
2
Platform Invalid 오류
1
239
3
WSL 설치 관련 문의드립니다!!
1
139
2
Vivado 툴, 파일 질문드립니다!
1
232
2
9장 LED 점등 안됨
1
162
3
Edit in IP Packager 이후에
1
122
1
Fpga 로직
1
139
2
pmu-fw is not running
1
207
2
Create Project에 대해서 궁금해요
1
123
2
장치관리자 USB 포트
1
154
2
FPGA 7장 AXI_LITE I/F질문
1
118
1





