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설계독학맛비's 실전 FPGA를 이용한 HW 가속기 설계 (LED 제어부터 Fully Connected Layer 가속기 설계까지)

[FPGA 10장] FSM 기본코어 IDLE -> RUN -> DONE 모듈을 FPGA 에 올려보기 HW Sleep 함수 구현 (PS <-> PL 간의 통신 방법 익히기2) - 실습편

10장 질문

해결된 질문

556

윤두현

작성한 질문수 4

1

안녕하세요 맛비님!

FPGA 10강을 수강하던 중 질문사항이 생겨 문의드립니다!

보드에 설계를 올린 후 read 과정에서 reg0에 100MHz 값을 넣었기 때문에 reg0 만 read 하신걸로 알고있는데,

실습을 따라하던 중, reg1,2,3 값이 궁금하여 read 해보았는데 아래와 같은 값을 읽어왔습니다.

read reg 123.png

혹시 이 값들은 무엇을 의미하는건지, 아무것도 저장을 하지 않았다면 왜 reg1 에만 5라는 값이 저장되어있던건지 궁금합니다!

임베디드 임베디드 fpga

답변 1

0

설계독학맛비

안녕하세요 :)

HW 코드를 보시면 답이 될 것 같아요.

image

1 번부분에는 reg 가 없습니다. SW 에서 값을 쓸 수 없죠.

1번은 상태를 나타내고요.

image

5 라고 하셨으니까, 2'b101 이겠네요.

r_done 이 나왔고, idle 인상태입니다.

 

 

즐공하세요 :)

0

윤두현

이해했습니다

항상 친절한 답변 감사해요!! :)

HW가속기 설계에서 더 보완할 수 있는 방법이 있을까요?

0

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