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설계독학맛비's 실전 FPGA를 이용한 HW 가속기 설계 (LED 제어부터 Fully Connected Layer 가속기 설계까지)

10장 질문입니다

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맛비님 강의 잘 듣고 있습니다.

 

10장에서 slv_reg 0하고 slv_reg 1만 쓰셨는데 (control과 status로)

0x04번지는 read로 사용하는 곳이라 주석처리한것은 이해가 되는데

slv_reg2랑 slv_reg3도 안쓰는것 아닌가요??

혹시 이부분은 왜 주석처리를 안하셨는지.. 이유가 있을까요? 단순히 궁금해서 질문드립니다!

답변 1

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설계독학맛비
지식공유자

안녕하세요 :)

설계자의 마음대로다. 가 답이고요.

현강의에서의 설계자인 제가 R/W 를 전부 사용하게 하고 싶어서 주석처리를 안했습니다. (특별한.. 이유는 없습니다.)

질문자 님께서 "난 R 만 하게 할꺼야. 그래도 동작에 문제가 없어." 라고 하시면 주석처리 하셔도 됩니다.

즐공하세요 :)

 

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