true_sync_dpbram.v
325
작성한 질문수 8
답변 2
1
안녕하세요 :)
충분한 search 및 생각 이후에 질문을 부탁드릴께요 (10분도 안되서 여러개가 달리니까...) + 강의 관련 질문만.. 부탁... (ㅠ.ㅠ)
[1] true_sync_dpbram.v 파일
방법은 어찌보면 여러가지 인데, (궁금하시면 구글링 해보기)
링크가 오류가 있네요;; 이렇게 찾아서 보셔요.
[2] 오개념 점검
IP 가 없음으로 호출이 불가합니다!!! (당연한 이야기 이죠..?)
IP 와 Primitive cell 을 구분지으시면 될 것 같아요. (구글링 해보기)
즐공하세요 :)
수강 순서 질문 있습니다
1
78
2
UART의 역할이 PC와 PS를 연결해 주는 역할로 알고 있습니다.
1
85
2
HW가속기 설계에서 더 보완할 수 있는 방법이 있을까요?
1
94
2
UART0, 1 중 선택
1
130
2
datamoverbram모듈질문
1
104
2
vitis 설치엣 alveo kria versal 등 옵션을 끄고 설치를 했습니다.
1
156
2
vitis 설치 관련 질문 있습니다!
1
158
2
FPGA 공식문서 읽는법
1
156
2
보드 추가의 클릭창이 없습니다.
1
121
2
Edit in IP Packager에서 코드 수정 후 IP 수정하면 simulation에서 수정된 코드로 작동이 안됩니다
1
161
2
BRAM의 Read / Write를 다 수행했는지 확인할 때 사용되는 num_cnt / i_num_cnt 관련 질문
1
146
1
Vitis 코드 작성
1
177
2
vivado 및 vitis 리눅스 환경 설치 관련 질문드립니다.
1
370
3
[9장 led 점등 시간 제어 불가]
1
146
2
Platform Invalid 오류
1
249
3
WSL 설치 관련 문의드립니다!!
1
143
2
Vivado 툴, 파일 질문드립니다!
1
242
2
9장 LED 점등 안됨
1
168
3
Edit in IP Packager 이후에
1
126
1
Fpga 로직
1
143
2
pmu-fw is not running
1
218
2
Create Project에 대해서 궁금해요
1
127
2
장치관리자 USB 포트
1
158
2
FPGA 7장 AXI_LITE I/F질문
1
123
1





