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Taiwan

작성한 질문수

설계독학맛비's 실전 FPGA를 이용한 HW 가속기 설계 (LED 제어부터 Fully Connected Layer 가속기 설계까지)

[FPGA 8장] HW IP 를 제어하기 위한 AXI4-Lite Interface 이해하기 - 실습편 (HW Debug 를 위한 ILA 사용)

2021.2 비바도를 사용하고 있습니다..

작성

466

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안녕하세요 맛비 선생님.. 비바도 2021.1 버전을 사용하고 있습니다. 

makefile 3가지 모두 수정 후 빌드를 하였지만 여전히 에러가 뜨네요 혹시 해결방안 있을까요? 

임베디드 fpga

퀴즈

AXI4-Lite 인터페이스는 하드웨어 IP 제어 시 주로 어떤 목적으로 사용될까요?

대용량 데이터의 고속 스트리밍 전송

하드웨어 IP의 내부 레지스터 설정 및 상태 확인

메모리 간의 복잡한 데이터 전송 프로토콜 구현

여러 칩 간의 동기화되지 않은 통신

답변 4

유승재

https://programmerah.com/vitis-platform-out-of-date-makefile-error-at-compile-time-the-modified-application-compiles-to-undefined-reference-32796/

저는 이걸 보고 해결하였습니다.

설계독학맛비

지식공유자

와.... 뭐죠....?! 이 스윗함?은!!!!!!!!!!!!!!!!!

해드릴 수 있는게 하트를 누르는 것 말고는 없네요.

저도 직접 해볼께요. 링크 감사합니다 :)

Taiwan

질문자

와 .. 일있어서 지금 해봤는데 version2? 로 하니까 되는거 같습니다 감사합니다!!

설계독학맛비

지식공유자

확인했구요.

Xilinx 가.. 툴버전을 업데이트하면서 이 이슈는 계속 수정을 안해주네요.. ㅠㅠ

추가 촬영했습니다. 내일 밤에 편집해서 업로드 하고 다시 남겨드릴께요.

Taiwan

질문자

감사합니다 ㅠㅠ 바쁘신 와중에 영상까지.. 감사합니다

설계독학맛비

지식공유자

안녕하세요 :)

강의 커리큘럼에 다음처럼 추가하였습니다.

앞으로도 Vivado Tool 버전 업시, 수정을 안해줄 것 같아서, 8장 이후에 사용하는 방법? 으로 업데이트 하였습니다.

즐공하세요 :)

FPGA 8장 실습 개정 추가.

설계독학맛비

지식공유자

안녕하세요 :)

2021.1 은 Test 를 못 해봐서, 현재는 잘 모르겠습니다. ㅠㅠ

죄송하지만, 주말에 2021.1 로 Test 해보고 답변 드리도록 하겠습니다.

조금만? 기다려주세요!

Taiwan

작성한 질문수

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