inflearn logo
강의

강의

N
챌린지

챌린지

멘토링

멘토링

N
클립

클립

로드맵

로드맵

지식공유

설계독학맛비's 실전 FPGA를 이용한 HW 가속기 설계 (LED 제어부터 Fully Connected Layer 가속기 설계까지)

[FPGA 12장] AXI4-Lite I/F 를 사용하여 Register 가 아닌 메모리에 Write / Read 해보기 - 코드리뷰편

Address 질문.

해결된 질문

375

지루한 까치

작성한 질문수 8

1

맛비님 안녕하세요!

Address map을 봤는데 궁금한 점이 생겨서 질문 드립니다!

address 를 0x08번지와 0x0c 번지를 사용하는 이유가 있나요?? 아니면 임의로 편하신 주소에 설정하신 건가요?? 다른 주소로 변경해서 사용해도 될까요??

---------------------------------------------------------

추가적으로 testbench 파일을 추가하고 시뮬레이션을 돌리려고 보니 빨간줄이 뜨는 구문이 생깁니다.. 그래도 잘 돌아가기는 하는데 오류가 아니라 경고문인가요?? vivado 에서 구문을 지원해주지 않아서 생기는 건가요??

항상 감사드립니다!

fpga 임베디드

답변 1

1

설계독학맛비

정말 죄송한데, 설명에 그림(캡쳐)도 같이 올려주시면 안될까요?!

상세히 적어주시면 도움이 됩니다. ㅠㅠ

0

지루한 까치

죄송합니다! 그 밑에 추가적인 질문은 제가 다시 실행해봤는데 이상없었습니다.

영상에서 빨간줄 쳐져있어서 저도 쳐진줄 알았는데 완료되고 보니 사라졌습니다!

이 부분은 첫번째 질문 사진입니다!

0

설계독학맛비

address 를 0x08번지와 0x0c 번지를 사용하는 이유가 있나요?? 아니면 임의로 편하신 주소에 설정하신 건가요?? 다른 주소로 변경해서 사용해도 될까요??

그럼요!!! 원하시는 Address 에 맞춰서 사용하시면 됩니다. (물론 verilog Code 는 수정해야겠죠?)

특별히 0x08 에 넣은 이유는 없어요. (순서대로 assign 하다보니까...)

즐공하세요 :)

0

지루한 까치

감사합니다!

HW가속기 설계에서 더 보완할 수 있는 방법이 있을까요?

1

52

2

UART0, 1 중 선택

1

85

2

datamoverbram모듈질문

1

85

2

vitis 설치엣 alveo kria versal 등 옵션을 끄고 설치를 했습니다.

1

113

2

vitis 설치 관련 질문 있습니다!

1

109

2

FPGA 공식문서 읽는법

1

111

2

보드 추가의 클릭창이 없습니다.

1

82

2

Edit in IP Packager에서 코드 수정 후 IP 수정하면 simulation에서 수정된 코드로 작동이 안됩니다

1

95

2

BRAM의 Read / Write를 다 수행했는지 확인할 때 사용되는 num_cnt / i_num_cnt 관련 질문

1

115

1

Vitis 코드 작성

1

138

2

vivado 및 vitis 리눅스 환경 설치 관련 질문드립니다.

1

314

3

[9장 led 점등 시간 제어 불가]

1

90

2

Platform Invalid 오류

1

162

3

WSL 설치 관련 문의드립니다!!

1

113

2

Vivado 툴, 파일 질문드립니다!

1

176

2

9장 LED 점등 안됨

1

126

3

Edit in IP Packager 이후에

1

98

1

Fpga 로직

1

104

2

pmu-fw is not running

1

143

2

Create Project에 대해서 궁금해요

1

99

2

장치관리자 USB 포트

1

116

2

FPGA 7장 AXI_LITE I/F질문

1

93

1

bram mover에서 합성할때

1

85

2

타이밍 위반 질문

1

85

2