Armアーキテクチャ:メモリマネジメント(MMU) [著者直講 3部-5]
システムソフトウェアの基本中の基本、最新Armアーキテクチャ(Armv8-A, Armv7-A)の核である「メモリマネジメント(MMU)」を、『システムソフトウェア開発のためのArmアーキテクチャの構造と原理』の著者がしっかりと解説します!
受講生 127名
難易度 初級
受講期間 無制限
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- 解決
MMU와 캐시의 관계
안녕하세요, 최근 TF-A 기반 부트로더에 대해 공부중인데, 부팅 단계에서 MMU가 특별히 물리주소를 별도의 가상주소로 매핑할 필요 없이, 지정된 물리영역을 가상주소에 그대로 1대1 매핑하여 사용한다는 사실을 알게되었습니다. (물리주소 0x0000_0000 -&g
arm-architecturememory-managementarmv8cortex-aonewhdwls130782
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실무적인 내용 문의드립니다!
최근 회사에서 팀을 옮기면서 소프트웨어 관련 업무를 하고 있습니다. 전 개발자도 아니였고, 이전 근무지에서 관련 업무를 하지 않았기 때문에 최근 열심히 임베디드/소프트웨어 관련 강의를 열심히 듣고 있는데요. (열심히 듣다보니 개념
arm-architecturememory-managementarmv8cortex-aalfmr58536590
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MMU의 Page Table과 관련된 질문이 있습니다.
TTBR_ELn 레지스터가 가지고 있는 값은 물리 메모리 주소값을 가지고 있는 건가요?TTBRn레지스터와 가상주소 변환(멀티 레벨) 강의에서 12:12 쯤에 말씀해주신 "페이지 테이블에 적힌 물리 메모리 주소를 다시 가상
arm-architecturememory-managementarmv8cortex-asdyeob10024541
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mmu table 위치
안녕하세요mmu 가 page walk 를 한다고 나와 있는데요,mmu 가 multi level page 인 경우 page walk 를 알아서 찾아 가게 설계 되어 있는 건가요?(hardware 단에서 처리?) 어디까지
arm-architecturememory-managementarmv8cortex-aplatformpjt040819
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mmu page walk
안녕하세요, mmu 가 page walk 할 때 다음 레벨 페이지 주소가 가상주소인가요, 실제주소인가요? 가상주소라면 mmu 를 또 거치게 될 것 같은데, page walk 에서 page fault 가 너무 많이 일어날 수
arm-architecturememory-managementarmv8cortex-aplatformpjt040819
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폴트 설정 비트 필드 질문
폴트 설정하는 레지스터들의 값을 0으로 설정하여 EL0에서 EL1, EL2로 트랩되도록 허용하는 것이 보안수준을 왜 올리는 것인지 문의드립니다. 제가 생각했을 때는 사용자 레벨(EL0)에서 더 상위 익셉션 레벨(EL1, EL2)로 접근할 수 있도록 설정하는 것이
arm-architecturememory-managementarmv8cortex-agrapesgun0624
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멀티레벨테이블로 운영하는 이유
안녕하세요. 가상메모리를 물리주소로 변환하기 위해서 멀티레벨페이지로 운영하는 이유가 궁금합니다. 멀티레벨페이지로 운영했을때 어떤 장점들이 있는지 궁금합니다.
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