Verilog FPGA Program 2 (MicroBlaze2, Arty A7-35T)

Name: Verilog FPGA Program 2 (MicroBlaze2, Arty A7-35T)
Price: 82500 KRW
Rating: 5 (3 reviews)

이 강의는 Microblaze 고급 과정입니다. 강의를 통해 Microblaze 응용 방법을 배울 수 있습니다.

(5.0) 수강평 3개

수강생 39명

난이도 중급이상

수강기한 무제한

alex

텍스트 강의

fpga

MicroBlaze

verilog

FPGA

텍스트 강의

fpga

MicroBlaze

verilog

FPGA

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먼저 경험한 수강생들의 후기

5.0

mjs1004

99% 수강 후 작성

실무에 적용하기에 적합한 형태로 구성되어 있다라고 생각합니다. 항삼 감사드립니다!

5.0

jblee3

100% 수강 후 작성

실무에 도움이 되는 내용입니다.

5.0

haneuli

100% 수강 후 작성

뒤늦게 FPGA 하게 되었는데 ㅠㅠ 이런 단비와 같은 자료를 오픈해주셔서 감사합니다! 정말 맨땅에서부터 공부 시작해봤음 공감될 막막함이 해소되어 행복합니다~

수강 후 이런걸 얻을 수 있어요

FPGA 에서 MicroBlaze 사용하기
Verilog 프로그램
w5500 인터페이스 구현

공부하기 막막한 FPGA MicroBlaze!
강의와 함께라면 뽀갤 수 있어요 💪

📢 수강 전 참고해주세요.

본 강의는 전자문서(PDF) 형식으로 구성된 텍스트 강의입니다. 강의를 수강하시는 분들께는 강의에 설명되어 있는 모든 소스 파일을 제공합니다. 강의 소스 코드는 섹션 0 [자료 공유 링크]에서 다운받을 수 있습니다.
본 강의는 [FPGA MicroBlaze 구현] 강의에 이어지는 활용 강의입니다. 프로그램 설치 관련 사항은 이전 강의에 자세히 설명되어 있습니다.

강의 주제 📖

본 강의는 MicroBlaze 응용편입니다. MicroBlaze 기초편에는 MicroBlaze의 기본적인 내용을 이해하고 활용하는 것에 중점을 두었습니다. 응용편에서는 Block Memory를 활용하는 것을 기반으로, w5500을 이용한 고속 TCP/IP를 구현하는 것을 설명합니다. 사용자 로직과 MicroBlaze와의 인터페이스를 구현하고 이를 활용하는 내용을 다루게 됩니다.

본 강의는 vivado 2022.1 버전을 사용합니다. 설치 관련 사항은 Microblaze 기초편에 자세히 설명되어 있습니다. 본 강의는 개발 경력 20년 이상의 개발자가 Arty A7 보드에서 소스 코드를 직접 구현하고 검증한 내용입니다. 강의에 설명된 내용들을 충분히 학습하고 자기 것으로 소화한다면 매우 능력 있는 개발자가 되실 수 있습니다. 자료실에서 다운받은 소스는 실무에서 사용해도 전혀 문제가 없는 고급 코드들입니다. 현업에서 많은 분이 사용할 수 있길 기대합니다.

이런 분들께 추천합니다.

1️⃣

Verilog 문법을 이해하고,
FPGA 설계 경험이 있는 분

2️⃣

임베디드 시스템(FW)
개발 경험이 있으신 분

학습 내용 📚

Vivado Design Block 구현

User logic Design 및 Simulation

Vitis 응용 SW 구현

보드 다운로드 및 결과 확인

상세 커리큘럼이 궁금하다면?

개요 (3)
Block Memory Interface - 1 (4)
1. 프로젝트 생성 (5)
2. Block Design (7)
3. Constraints 파일 추가 (17)
4. 응용 SW 구현 (12)
5. 결과 확인 (24)
  1. Build Project (24)
  2. 프로그램 다운로드 (25)
Block Memory Interface - 2 (29)
1. 프로젝트 생성 (30)
2. Block Design (31)
3. User Logic Design (40)
4. 응용 SW 구현 (50)
5. 다운로드 및 결과 확인 (53)
6. 링크 스크립트 수정 (56)
w5500 인터페이스 구현 (58)
1. System Block (59)
2. 프로젝트 생성 (61)
3. Block Design (62)
4. User Logic Design (70)
5. w5500 spi timing (74)
6. 소스 코드 분석 (75)
  1. ax_reg 모듈 (75)
  2. eth_task 모듈 (77)
  3. eth_task simulation (87)
  4. bramW5500Top 모듈 (95)
  5. xdc 파일 (98)
7. 응용 SW 구현 (99)
  1. data_type.h (105)
  2. ax_common.h (105)
  3. w5500.c, w5500.h (105)
  4. w5500_task.c, w5500_task.h (106)
  5. w5500_socket.c, w5500_socket.h (106)
  6. w5500_loopback.c, w5500_loopback.h (107)
  7. helloworld.c (109)
8. 결과 확인 (110)
  1. Build Projec (110)
  2. PC Network 설정 (111)
  3. 프로그램 다운로드 (112)
  4. 결과 확인 (115)
  5. 외부 Flash에 프로그램 다운로드 (118)
9. 결론 (119)
참고 자료 (120)
Revision History (121)

예상 질문 Q&A 💬

Q. 강의를 듣는 대상자는 누구인가요?

Verilog 문법을 이해하고, FPGA 설계 경험이 있으며, 임베디드 시스템(FW) 개발 경험이 있으신 분들을 대상으로 합니다. Microblaze를 처음 접하신다면, 기초 강의를 수강하신 후 본 강의를 수강하시길 바랍니다.

Q. 강의를 듣기 위해 준비해야 할 사항이 있나요?

본 강의는 실습 보드 Arty A7-35T(100T, Digilent 사 제품)에서 진행됩니다. 만약 보드가 준비되지 않았다면 먼저 내용을 보시고 나중에 보드를 구입해서 반드시 보드 상에서 확인하시길 바랍니다.

Q. 프로그램 툴은 무엇을 사용하나요?

최신 버전인 vitis 2022.1 버전을 사용합니다. 설치 과정은 Microblaze 기초 강의에 자세히 소개되어 있습니다.

지식공유자 소개 ✒️

이력 사항

저는 20여 년 동안 대기업, 중소기업에서 개발자로 일해왔고 현재는 작은 기업을 운영하고 있습니다. CCTV용 ISP(Image Signal Processing) ASIC을 개발하였고 OLED 검사 장비, DAQ (Data Acquisition System) 등 FPGA를 이용한 많은 제품을 개발하였습니다. FPGA뿐만 아니라 FW 개발 (STM32, PIC32, AVR, ATMEGA 등), 회로 설계, Windows Program 등 많은 경험을 가지고 있습니다.

이런 분들께
추천드려요

학습 대상은
누구일까요?

MicroBlaze 관심 있으신 분
FPGA 관심 있으신 분
Verilog 관심 있으신 분
Verilog 고급 기술을 배우고자 하시는 분

선수 지식,
필요할까요?

C 언어
Verilog HDL
Xilinx FPGA

안녕하세요
alex입니다.

1,768

명

수강생

개

수강평

128

개

답변

4.8

점

강의 평점

개

강의

저는 지난 20여년 동안 대기업, 중소기업에서 개발자로 일해왔고

현재는 작은 기업의 대표로 있습니다.

주요 경력사항은

Verilog HDL을 이용한 FPGA 설계
- CCTV용 ISP ASIC 개발 (약 10년)
- OLED Display 검사장비 개발 (약 3년)
- FPGA를 이용한 장비 개발
MCU FW
- STM32
- PIC32
- AVR, ATMEGA
- DSP (TI)
Windows Application Program
- Visual Studio MFC, C++

입니다.

커리큘럼

전체

121개

해당 강의에서 제공:

수업자료

섹션 1. 개요

2개

1. 개요
2. 자료 공유 링크

섹션 2. Block Memory Interface1

25개

섹션 3. Block Memory Interface2

29개

28. Block Memory Interface2 - 0
29. Block Memory Interface2 - 1
30. Block Memory Interface2 - 2
31. Block Memory Interface2 - 3
32. Block Memory Interface2 - 4
33. Block Memory Interface2 - 5
34. Block Memory Interface2 - 6
35. Block Memory Interface2 - 7
36. Block Memory Interface2 - 8
37. Block Memory Interface2 - 9
38. Block Memory Interface2 - 10
39. Block Memory Interface2 - 11
40. Block Memory Interface2 - 12
41. Block Memory Interface2 - 13
42. Block Memory Interface2 - 14
43. Block Memory Interface2 - 15
44. Block Memory Interface2 - 16
45. Block Memory Interface2 - 17
46. Block Memory Interface2 - 18
47. Block Memory Interface2 - 19
48. Block Memory Interface2 - 20
49. Block Memory Interface2 - 21
50. Block Memory Interface2 - 22
51. Block Memory Interface2 - 23
52. Block Memory Interface2 - 24
53. Block Memory Interface2 - 25
54. Block Memory Interface2 - 26
55. Block Memory Interface2 - 27
56. Block Memory Interface2 - 28

섹션 4. w5500 인터페이스 구현

62개

섹션 5. 기타

3개

강의 게시일: 2023. 03. 23.

마지막 업데이트일: 2025. 05. 13.

수강평

전체

3개

5.0

3개의 수강평

haneuli
수강평 15
∙
평균 평점 5.0
2023. 03. 24.
5
100% 수강 후 작성
뒤늦게 FPGA 하게 되었는데 ㅠㅠ 이런 단비와 같은 자료를 오픈해주셔서 감사합니다! 정말 맨땅에서부터 공부 시작해봤음 공감될 막막함이 해소되어 행복합니다~
- alex
  지식공유자
  2023. 03. 24.
  수강평 감사드립니다. 저도 처음에 fpga, verilog를 접하게 되었을 때 막막했었던 기억이 있습니다. 이론적으로는 대충 알겠는데, 이게 실제 무엇을 의미하는지는 일을 하면서 조금씩 조금씩 깨닫게 되었던 것 같습니다. 강의 통해 도움이 되셨다니 감사드리고, 훌륭한 개발자 되시길 바랍니다. 감사합니다 ~!!
jblee3
수강평 3
∙
평균 평점 5.0
2023. 03. 24.
5
100% 수강 후 작성
실무에 도움이 되는 내용입니다.
- alex
  지식공유자
  2023. 03. 24.
  수강평 감사드립니다~!!
mjs1004
수강평 4
∙
평균 평점 5.0
2025. 12. 18.
수정됨
5
99% 수강 후 작성
실무에 적용하기에 적합한 형태로 구성되어 있다라고 생각합니다. 항삼 감사드립니다!

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5.0

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100+

강의을 통하여 FPGA를 이용한 DDR Controller를 구현할 수 있습니다.

중급이상

verilog, FPGA

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본 강의는 DDR Memory Arbiter를 구현합니다.

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이 강의를 통하여 수강생들은 Zynq 보드를 활용하여 Verilog를 구현하는 내용을 배우게 됩니다.

초급

Verilog HDL, FPGA, zynq

Verilog FPGA Program 1 (Zynq mini 7020)

alex

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초급 / Verilog HDL, FPGA, zynq

5.0

(4)

Verilog FPGA Program 6 - DDR Arbiter (HIL-A35T)

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₩110,000

초급 / Verilog HDL, FPGA

본 강의는 DDR Memory Arbiter를 구현합니다.

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FPGA에 UART 구현하기

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초급 / FPGA, system-verilog, uart, vivado

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미션

UART는 가장 기본적이며 널리 활용되는 시리얼 통신 방식으로, FPGA 설계를 처음 접하는 입문자에게 매우 적합한 학습 주제입니다. 본 강의에서는 UART의 통신 원리와 프레임 구조를 상세히 이해하고, 이를 기반으로 RTL(Register Transfer Level) 설계를 통해 송수신 로직을 직접 구현해보는 과정을 진행합니다. FPGA 상에서 UART를 구현함으로써 디지털 회로 설계 능력을 체계적으로 키우고, 시뮬레이션 및 검증을 통해 실제 하드웨어 수준에서 동작을 확인하는 경험을 쌓을 수 있습니다. 또한 Soft Processor인 MicroBlaze와 Xilinx UART IP를 활용한 방식도 함께 학습하여, 프로세서 기반의 시스템 설계 흐름 및 인터페이스 구성을 폭넓게 이해하게 됩니다. 이를 통해 논리 설계와 프로세서 설계를 아우르는 포괄적인 개발 역량을 갖출 수 있습니다.

초급

FPGA, system-verilog, uart

FPGA에 UART 구현하기

EasyFPGA

₩27,500

초급 / FPGA, system-verilog, uart, vivado

5.0

(1)

미션

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5.0

수강 후 이런걸 얻을 수 있어요

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이런 분들께 추천합니다.

학습 내용 📚

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이력 사항

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