이번 실기일까지 강의를 듣고 싶어요.
[퇴근후딴짓] 빅데이터 분석기사 실기 (작업형1,2,3)
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찰스
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173만명의 커뮤니티!! 함께 토론해봐요.
[퇴근후딴짓] 빅데이터 분석기사 실기 (작업형1,2,3)
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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)
연산 규모가 늘어날수록 HW/SW의 격차는 어마무시해진다고 맛비님이 강의에서 말씀하셨죠. 얼마나 어마무시해질지 궁금해서, for문의 마지막에 정말로 1억을 넣고 시뮬레이션을 돌렸습니다. 그러니까 연산의 마지막에는 1억의 8제곱을 계산한 것입니다. 결과는 아래와 같습니다. - SW(C 코드): 23초 - HW(Verilog): 1초(시뮬레이션상 시간) 23배라는 차이를 보였습니다. 실험 결과를 공유하고 HW의 유용함을 알리기 위해 이 글을 적었습니다!
파이썬/장고 웹서비스 개발 완벽 가이드 with 리액트
본 강의에서 알려주신 판다스 및 이미지 활용 예제를 알려주셔서 감사합니다. 강의 후반에 알려주신 것 처럼 활용 할 수 있는 부분이 굉장히 많아 보입니다. 판다스 예제를 views.py에 녹여 봤는데, 잘 출력됩니다 ㅎㅎ 이후 템플릿 폴더 내부 html 파일을 생성해서 디자인 좀 추가해 출력하면 분석 툴 제작도 충분히 가능할 듯 싶네요. 강의 중반까지 듣고 시도해 보겠습니다 :)