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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

[HDL 15장] HW 의 동작을 제어하는 FSM 을 이해해보자. (이론편) - (원리만 깨달으면 자판기, 시계는 금방 설계합니다.)

HW 엔지니어 코딩 인터뷰

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kjw950420
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안녕하세요

좋은 강의 너무 잘 보고 있습니다.

HW 엔지니어 또한 코딩 테스트를 본다고 말씀하셨는데, HW 엔지니어를 준비하는 저로서는 테스트 준비가 부담이 아닐 수 없습니다. 그래서 강의를 보고 몇 가지 질문이 있어서 글을 작성합니다.

[1] 일반적으로 컴퓨터 프로그래머 분들처럼 알고리즘을 테스트로 보나요? (백준 알고리즘 사이트에 나오는 문제 유형같이 말입니다.)

[2] Verilog나 VDHL을 테스트로 보나요 아니면 C나 python 을 테스트로 보나요?

[3] 그리고 이 질문은 실습과 관련한 질문입니다. 실습을 위한 ".v" 파일을 새로 만들고 싶은데 이럴 경우 리눅스 상에서 만들 수 있는 방법이 있나요? 만들 수 있다면 어떻게 만들 수 있는지 알고 싶습니다.

좋은 답변 기다리겠습니다. 

감사합니다. 

답변 2

1

kjw950420

정말 좋은 답변 감사드립니다. 링크 참고 잘 하겠습니다.

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설계독학맛비

다행이네요 ㅎ 즐거운하루되세요 :)

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설계독학맛비

안녕하세요 :)

좋은 답변 기다리겠습니다.. 너무 무섭네요 ㅠ.ㅠ 노력해보겠습니다 ㅎ

[1] 일반적으로 컴퓨터 프로그래머 분들처럼 알고리즘을 테스트로 보나요? (백준 알고리즘 사이트에 나오는 문제 유형같이 말입니다.)

대기업에서 Verilog HDL 로 Test 를 보진 않았었구요. 중소기업에서 봤었습니다. 제가 다니는 스타트업도 보구요. 신입 같은 경우에는 Verilog HDL 을 하실줄안다 라고 하면 Verilog HDL 로 간단한 모듈설계, 예를 들면 fsm 카운터? 정도 보구요. (못푸는 사람 많아요) Verilog HDL 을 할 줄 모르면 C 로 간단한 알고리즘 Test 를 봅니다. 백준 유형에서 쉬운 난이도 입니다. 어려운거는 출제를 안합니다. (네카라쿠배 같은 SW 와 다른 일을 하니까요.)

[2] Verilog나 VDHL을 테스트로 보나요 아니면 C나 python 을 테스트로 보나요?

위의 답변이 답이 되었을 것 같아요. HW 설계 엔지니어 지원이면, Python 은 코테에 사용하지 않습니다.

[3] 그리고 이 질문은 실습과 관련한 질문입니다. 실습을 위한 ".v" 파일을 새로 만들고 싶은데 이럴 경우 리눅스 상에서 만들 수 있는 방법이 있나요? 만들 수 있다면 어떻게 만들 수 있는지 알고 싶습니다.

예전에 여쭤보신분이 있어서 링크를 공유드립니다.

https://inf.run/axDV

혹시 링크 안보이시면 말씀하셔요.

그럼 즐공입니다. :)